arch/arm/include/asm/io.h

   1 /*
   2  *  arch/arm/include/asm/io.h
   3  *
   4  *  Copyright (C) 1996-2000 Russell King
   5  *
   6  * This program is free software; you can redistribute it and/or modify
   7  * it under the terms of the GNU General Public License version 2 as
   8  * published by the Free Software Foundation.
   9  *
  10  * Modifications:
  11  *  16-Sep-1996 RMK     Inlined the inx/outx functions & optimised for both
  12  *                      constant addresses and variable addresses.
  13  *  04-Dec-1997 RMK     Moved a lot of this stuff to the new architecture
  14  *                      specific IO header files.
  15  *  27-Mar-1999 PJB     Second parameter of memcpy_toio is const..
  16  *  04-Apr-1999 PJB     Added check_signature.
  17  *  12-Dec-1999 RMK     More cleanups
  18  *  18-Jun-2000 RMK     Removed virt_to_* and friends definitions
  19  *  05-Oct-2004 BJD     Moved memory string functions to use void __iomem
  20  */
  21 #ifndef __ASM_ARM_IO_H
  22 #define __ASM_ARM_IO_H
  23
  24 #ifdef __KERNEL__
  25
  26 #include <linux/types.h>
  27 #include <asm/byteorder.h>
  28 #include <asm/memory.h>
  29 #include <asm/system.h>
  30 #include <asm-generic/pci_iomap.h>
  31
  32 /*
  33  * ISA I/O bus memory addresses are 1:1 with the physical address.
  34  */
  35 #define isa_virt_to_bus virt_to_phys
  36 #define isa_page_to_bus page_to_phys
  37 #define isa_bus_to_virt phys_to_virt
  38
  39 /*
  40  * Generic IO read/write.  These perform native-endian accesses.  Note
  41  * that some architectures will want to re-define __raw_{read,write}w.
  42  */
  43 extern void __raw_writesb(void __iomem *addr, const void *data, int bytelen);
  44 extern void __raw_writesw(void __iomem *addr, const void *data, int wordlen);
  45 extern void __raw_writesl(void __iomem *addr, const void *data, int longlen);
  46
  47 extern void __raw_readsb(const void __iomem *addr, void *data, int bytelen);
  48 extern void __raw_readsw(const void __iomem *addr, void *data, int wordlen);
  49 extern void __raw_readsl(const void __iomem *addr, void *data, int longlen);
  50
  51 #define __raw_writeb(v,a)       (__chk_io_ptr(a), *(volatile unsigned char __force  *)(a) = (v))
  52 #define __raw_writew(v,a)       (__chk_io_ptr(a), *(volatile unsigned short __force *)(a) = (v))
  53 #define __raw_writel(v,a)       (__chk_io_ptr(a), *(volatile unsigned int __force   *)(a) = (v))
  54
  55 #define __raw_readb(a)          (__chk_io_ptr(a), *(volatile unsigned char __force  *)(a))
  56 #define __raw_readw(a)          (__chk_io_ptr(a), *(volatile unsigned short __force *)(a))
  57 #define __raw_readl(a)          (__chk_io_ptr(a), *(volatile unsigned int __force   *)(a))
  58
  59 /*
  60  * Architecture ioremap implementation.
  61  */
  62 #define MT_DEVICE               0
  63 #define MT_DEVICE_NONSHARED     1
  64 #define MT_DEVICE_CACHED        2
  65 #define MT_DEVICE_WC            3
  66 /*
  67  * types 4 onwards can be found in asm/mach/map.h and are undefined
  68  * for ioremap
  69  */
  70
  71 /*
  72  * __arm_ioremap takes CPU physical address.
  73  * __arm_ioremap_pfn takes a Page Frame Number and an offset into that page
  74  * The _caller variety takes a __builtin_return_address(0) value for
  75  * /proc/vmalloc to use - and should only be used in non-inline functions.
  76  */
  77 extern void __iomem *__arm_ioremap_pfn_caller(unsigned long, unsigned long,
  78         size_t, unsigned int, void *);
  79 extern void __iomem *__arm_ioremap_caller(unsigned long, size_t, unsigned int,
  80         void *);
  81
  82 extern void __iomem *__arm_ioremap_pfn(unsigned long, unsigned long, size_t, unsigned int);
  83 extern void __iomem *__arm_ioremap(unsigned long, size_t, unsigned int);
  84 extern void __iomem *__arm_ioremap_exec(unsigned long, size_t, bool cached);
  85 extern void __iounmap(volatile void __iomem *addr);
  86 extern void __arm_iounmap(volatile void __iomem *addr);
  87
  88 extern void __iomem * (*arch_ioremap_caller)(unsigned long, size_t,
  89         unsigned int, void *);
  90 extern void (*arch_iounmap)(volatile void __iomem *);
  91
  92 /*
  93  * Bad read/write accesses...
  94  */
  95 extern void __readwrite_bug(const char *fn);
  96
  97 /*
  98  * A typesafe __io() helper
  99  */
 100 static inline void __iomem *__typesafe_io(unsigned long addr)
 101 {
 102         return (void __iomem *)addr;
 103 }
 104
 105 /* IO barriers */
 106 #ifdef CONFIG_ARM_DMA_MEM_BUFFERABLE
 107 #define __iormb()               rmb()
 108 #define __iowmb()               wmb()
 109 #else
 110 #define __iormb()               do { } while (0)
 111 #define __iowmb()               do { } while (0)
 112 #endif
 113
 114 /*
 115  * Now, pick up the machine-defined IO definitions
 116  */
 117 #include <mach/io.h>
 118
 119 /*
 120  * This is the limit of PC card/PCI/ISA IO space, which is by default
 121  * 64K if we have PC card, PCI or ISA support.  Otherwise, default to
 122  * zero to prevent ISA/PCI drivers claiming IO space (and potentially
 123  * oopsing.)
 124  *
 125  * Only set this larger if you really need inb() et.al. to operate over
 126  * a larger address space.  Note that SOC_COMMON ioremaps each sockets
 127  * IO space area, and so inb() et.al. must be defined to operate as per
 128  * readb() et.al. on such platforms.
 129  */
 130 #ifndef IO_SPACE_LIMIT
 131 #if defined(CONFIG_PCMCIA_SOC_COMMON) || defined(CONFIG_PCMCIA_SOC_COMMON_MODULE)
 132 #define IO_SPACE_LIMIT ((resource_size_t)0xffffffff)
 133 #elif defined(CONFIG_PCI) || defined(CONFIG_ISA) || defined(CONFIG_PCCARD)
 134 #define IO_SPACE_LIMIT ((resource_size_t)0xffff)
 135 #else
 136 #define IO_SPACE_LIMIT ((resource_size_t)0)
 137 #endif
 138 #endif
 139
 140 /*
 141  *  IO port access primitives
 142  *  -------------------------
 143  *
 144  * The ARM doesn't have special IO access instructions; all IO is memory
 145  * mapped.  Note that these are defined to perform little endian accesses
 146  * only.  Their primary purpose is to access PCI and ISA peripherals.
 147  *
 148  * Note that for a big endian machine, this implies that the following
 149  * big endian mode connectivity is in place, as described by numerous
 150  * ARM documents:
 151  *
 152  *    PCI:  D0-D7   D8-D15 D16-D23 D24-D31
 153  *    ARM: D24-D31 D16-D23  D8-D15  D0-D7
 154  *
 155  * The machine specific io.h include defines __io to translate an "IO"
 156  * address to a memory address.
 157  *
 158  * Note that we prevent GCC re-ordering or caching values in expressions
 159  * by introducing sequence points into the in*() definitions.  Note that
 160  * __raw_* do not guarantee this behaviour.
 161  *
 162  * The {in,out}[bwl] macros are for emulating x86-style PCI/ISA IO space.
 163  */
 164 #ifdef __io
 165 #define outb(v,p)       ({ __iowmb(); __raw_writeb(v,__io(p)); })
 166 #define outw(v,p)       ({ __iowmb(); __raw_writew((__force __u16) \
 167                                         cpu_to_le16(v),__io(p)); })
 168 #define outl(v,p)       ({ __iowmb(); __raw_writel((__force __u32) \
 169                                         cpu_to_le32(v),__io(p)); })
 170
 171 #define inb(p)  ({ __u8 __v = __raw_readb(__io(p)); __iormb(); __v; })
 172 #define inw(p)  ({ __u16 __v = le16_to_cpu((__force __le16) \
 173                         __raw_readw(__io(p))); __iormb(); __v; })
 174 #define inl(p)  ({ __u32 __v = le32_to_cpu((__force __le32) \
 175                         __raw_readl(__io(p))); __iormb(); __v; })
 176
 177 #define outsb(p,d,l)            __raw_writesb(__io(p),d,l)
 178 #define outsw(p,d,l)            __raw_writesw(__io(p),d,l)
 179 #define outsl(p,d,l)            __raw_writesl(__io(p),d,l)
 180
 181 #define insb(p,d,l)             __raw_readsb(__io(p),d,l)
 182 #define insw(p,d,l)             __raw_readsw(__io(p),d,l)
 183 #define insl(p,d,l)             __raw_readsl(__io(p),d,l)
 184 #endif
 185
 186 #define outb_p(val,port)        outb((val),(port))
 187 #define outw_p(val,port)        outw((val),(port))
 188 #define outl_p(val,port)        outl((val),(port))
 189 #define inb_p(port)             inb((port))
 190 #define inw_p(port)             inw((port))
 191 #define inl_p(port)             inl((port))
 192
 193 #define outsb_p(port,from,len)  outsb(port,from,len)
 194 #define outsw_p(port,from,len)  outsw(port,from,len)
 195 #define outsl_p(port,from,len)  outsl(port,from,len)
 196 #define insb_p(port,to,len)     insb(port,to,len)
 197 #define insw_p(port,to,len)     insw(port,to,len)
 198 #define insl_p(port,to,len)     insl(port,to,len)
 199
 200 /*
 201  * String version of IO memory access ops:
 202  */
 203 extern void _memcpy_fromio(void *, const volatile void __iomem *, size_t);
 204 extern void _memcpy_toio(volatile void __iomem *, const void *, size_t);
 205 extern void _memset_io(volatile void __iomem *, int, size_t);
 206
 207 #define mmiowb()
 208
 209 /*
 210  *  Memory access primitives
 211  *  ------------------------
 212  *
 213  * These perform PCI memory accesses via an ioremap region.  They don't
 214  * take an address as such, but a cookie.
 215  *
 216  * Again, this are defined to perform little endian accesses.  See the
 217  * IO port primitives for more information.
 218  */
 219 #ifdef __mem_pci
 220 #define readb_relaxed(c) ({ u8  __r = __raw_readb(__mem_pci(c)); __r; })
 221 #define readw_relaxed(c) ({ u16 __r = le16_to_cpu((__force __le16) \
 222                                         __raw_readw(__mem_pci(c))); __r; })
 223 #define readl_relaxed(c) ({ u32 __r = le32_to_cpu((__force __le32) \
 224                                         __raw_readl(__mem_pci(c))); __r; })
 225
 226 #define writeb_relaxed(v,c)     ((void)__raw_writeb(v,__mem_pci(c)))
 227 #define writew_relaxed(v,c)     ((void)__raw_writew((__force u16) \
 228                                         cpu_to_le16(v),__mem_pci(c)))
 229 #define writel_relaxed(v,c)     ((void)__raw_writel((__force u32) \
 230                                         cpu_to_le32(v),__mem_pci(c)))
 231
 232 #define readb(c)                ({ u8  __v = readb_relaxed(c); __iormb(); __v; })
 233 #define readw(c)                ({ u16 __v = readw_relaxed(c); __iormb(); __v; })
 234 #define readl(c)                ({ u32 __v = readl_relaxed(c); __iormb(); __v; })
 235
 236 #define writeb(v,c)             ({ __iowmb(); writeb_relaxed(v,c); })
 237 #define writew(v,c)             ({ __iowmb(); writew_relaxed(v,c); })
 238 #define writel(v,c)             ({ __iowmb(); writel_relaxed(v,c); })
 239
 240 #define readsb(p,d,l)           __raw_readsb(__mem_pci(p),d,l)
 241 #define readsw(p,d,l)           __raw_readsw(__mem_pci(p),d,l)
 242 #define readsl(p,d,l)           __raw_readsl(__mem_pci(p),d,l)
 243
 244 #define writesb(p,d,l)          __raw_writesb(__mem_pci(p),d,l)
 245 #define writesw(p,d,l)          __raw_writesw(__mem_pci(p),d,l)
 246 #define writesl(p,d,l)          __raw_writesl(__mem_pci(p),d,l)
 247
 248 #define memset_io(c,v,l)        _memset_io(__mem_pci(c),(v),(l))
 249 #define memcpy_fromio(a,c,l)    _memcpy_fromio((a),__mem_pci(c),(l))
 250 #define memcpy_toio(c,a,l)      _memcpy_toio(__mem_pci(c),(a),(l))
 251
 252 #elif !defined(readb)
 253
 254 #define readb(c)                        (__readwrite_bug("readb"),0)
 255 #define readw(c)                        (__readwrite_bug("readw"),0)
 256 #define readl(c)                        (__readwrite_bug("readl"),0)
 257 #define writeb(v,c)                     __readwrite_bug("writeb")
 258 #define writew(v,c)                     __readwrite_bug("writew")
 259 #define writel(v,c)                     __readwrite_bug("writel")
 260
 261 #define check_signature(io,sig,len)     (0)
 262
 263 #endif  /* __mem_pci */
 264
 265 /*
 266  * ioremap and friends.
 267  *
 268  * ioremap takes a PCI memory address, as specified in
 269  * Documentation/io-mapping.txt.
 270  *
 271  */
 272 #define ioremap(cookie,size)            __arm_ioremap((cookie), (size), MT_DEVICE)
 273 #define ioremap_nocache(cookie,size)    __arm_ioremap((cookie), (size), MT_DEVICE)
 274 #define ioremap_cached(cookie,size)     __arm_ioremap((cookie), (size), MT_DEVICE_CACHED)
 275 #define ioremap_wc(cookie,size)         __arm_ioremap((cookie), (size), MT_DEVICE_WC)
 276 #define iounmap                         __arm_iounmap
 277
 278 /*
 279  * io{read,write}{8,16,32} macros
 280  */
 281 #ifndef ioread8
 282 #define ioread8(p)      ({ unsigned int __v = __raw_readb(p); __iormb(); __v; })
 283 #define ioread16(p)     ({ unsigned int __v = le16_to_cpu((__force __le16)__raw_readw(p)); __iormb(); __v; })
 284 #define ioread32(p)     ({ unsigned int __v = le32_to_cpu((__force __le32)__raw_readl(p)); __iormb(); __v; })
 285
 286 #define ioread16be(p)   ({ unsigned int __v = be16_to_cpu((__force __be16)__raw_readw(p)); __iormb(); __v; })
 287 #define ioread32be(p)   ({ unsigned int __v = be32_to_cpu((__force __be32)__raw_readl(p)); __iormb(); __v; })
 288
 289 #define iowrite8(v,p)   ({ __iowmb(); (void)__raw_writeb(v, p); })
 290 #define iowrite16(v,p)  ({ __iowmb(); (void)__raw_writew((__force __u16)cpu_to_le16(v), p); })
 291 #define iowrite32(v,p)  ({ __iowmb(); (void)__raw_writel((__force __u32)cpu_to_le32(v), p); })
 292
 293 #define iowrite16be(v,p) ({ __iowmb(); (void)__raw_writew((__force __u16)cpu_to_be16(v), p); })
 294 #define iowrite32be(v,p) ({ __iowmb(); (void)__raw_writel((__force __u32)cpu_to_be32(v), p); })
 295
 296 #define ioread8_rep(p,d,c)      __raw_readsb(p,d,c)
 297 #define ioread16_rep(p,d,c)     __raw_readsw(p,d,c)
 298 #define ioread32_rep(p,d,c)     __raw_readsl(p,d,c)
 299
 300 #define iowrite8_rep(p,s,c)     __raw_writesb(p,s,c)
 301 #define iowrite16_rep(p,s,c)    __raw_writesw(p,s,c)
 302 #define iowrite32_rep(p,s,c)    __raw_writesl(p,s,c)
 303
 304 extern void __iomem *ioport_map(unsigned long port, unsigned int nr);
 305 extern void ioport_unmap(void __iomem *addr);
 306 #endif
 307
 308 struct pci_dev;
 309
 310 extern void pci_iounmap(struct pci_dev *dev, void __iomem *addr);
 311
 312 /*
 313  * can the hardware map this into one segment or not, given no other
 314  * constraints.
 315  */
 316 #define BIOVEC_MERGEABLE(vec1, vec2)    \
 317         ((bvec_to_phys((vec1)) + (vec1)->bv_len) == bvec_to_phys((vec2)))
 318
 319 #ifdef CONFIG_MMU
 320 #define ARCH_HAS_VALID_PHYS_ADDR_RANGE
 321 extern int valid_phys_addr_range(unsigned long addr, size_t size);
 322 extern int valid_mmap_phys_addr_range(unsigned long pfn, size_t size);
 323 extern int devmem_is_allowed(unsigned long pfn);
 324 #endif
 325
 326 /*
 327  * Convert a physical pointer to a virtual kernel pointer for /dev/mem
 328  * access
 329  */
 330 #define xlate_dev_mem_ptr(p)    __va(p)
 331
 332 /*
 333  * Convert a virtual cached pointer to an uncached pointer
 334  */
 335 #define xlate_dev_kmem_ptr(p)   p
 336
 337 /*
 338  * Register ISA memory and port locations for glibc iopl/inb/outb
 339  * emulation.
 340  */
 341 extern void register_isa_ports(unsigned int mmio, unsigned int io,
 342                                unsigned int io_shift);
 343
 344 #endif  /* __KERNEL__ */
 345 #endif  /* __ASM_ARM_IO_H */