drivers/gpu/drm/amd/amdgpu/amdgpu_drv.c

   1 /**
   2  * \file amdgpu_drv.c
   3  * AMD Amdgpu driver
   4  *
   5  * \author Gareth Hughes <gareth@valinux.com>
   6  */
   7
   8 /*
   9  * Copyright 2000 VA Linux Systems, Inc., Sunnyvale, California.
  10  * All Rights Reserved.
  11  *
  12  * Permission is hereby granted, free of charge, to any person obtaining a
  13  * copy of this software and associated documentation files (the "Software"),
  14  * to deal in the Software without restriction, including without limitation
  15  * the rights to use, copy, modify, merge, publish, distribute, sublicense,
  16  * and/or sell copies of the Software, and to permit persons to whom the
  17  * Software is furnished to do so, subject to the following conditions:
  18  *
  19  * The above copyright notice and this permission notice (including the next
  20  * paragraph) shall be included in all copies or substantial portions of the
  21  * Software.
  22  *
  23  * THE SOFTWARE IS PROVIDED "AS IS", WITHOUT WARRANTY OF ANY KIND, EXPRESS OR
  24  * IMPLIED, INCLUDING BUT NOT LIMITED TO THE WARRANTIES OF MERCHANTABILITY,
  25  * FITNESS FOR A PARTICULAR PURPOSE AND NONINFRINGEMENT.  IN NO EVENT SHALL
  26  * VA LINUX SYSTEMS AND/OR ITS SUPPLIERS BE LIABLE FOR ANY CLAIM, DAMAGES OR
  27  * OTHER LIABILITY, WHETHER IN AN ACTION OF CONTRACT, TORT OR OTHERWISE,
  28  * ARISING FROM, OUT OF OR IN CONNECTION WITH THE SOFTWARE OR THE USE OR
  29  * OTHER DEALINGS IN THE SOFTWARE.
  30  */
  31
  32 #include <drm/drmP.h>
  33 #include <drm/amdgpu_drm.h>
  34 #include <drm/drm_gem.h>
  35 #include "amdgpu_drv.h"
  36
  37 #include <drm/drm_pciids.h>
  38 #include <linux/console.h>
  39 #include <linux/module.h>
  40 #include <linux/pm_runtime.h>
  41 #include <linux/vga_switcheroo.h>
  42 #include <drm/drm_crtc_helper.h>
  43
  44 #include "amdgpu.h"
  45 #include "amdgpu_irq.h"
  46
  47 #include "amdgpu_amdkfd.h"
  48
  49 /*
  50  * KMS wrapper.
  51  * - 3.0.0 - initial driver
  52  * - 3.1.0 - allow reading more status registers (GRBM, SRBM, SDMA, CP)
  53  * - 3.2.0 - GFX8: Uses EOP_TC_WB_ACTION_EN, so UMDs don't have to do the same
  54  *           at the end of IBs.
  55  * - 3.3.0 - Add VM support for UVD on supported hardware.
  56  * - 3.4.0 - Add AMDGPU_INFO_NUM_EVICTIONS.
  57  * - 3.5.0 - Add support for new UVD_NO_OP register.
  58  * - 3.6.0 - kmd involves use CONTEXT_CONTROL in ring buffer.
  59  * - 3.7.0 - Add support for VCE clock list packet
  60  * - 3.8.0 - Add support raster config init in the kernel
  61  * - 3.9.0 - Add support for memory query info about VRAM and GTT.
  62  * - 3.10.0 - Add support for new fences ioctl, new gem ioctl flags
  63  * - 3.11.0 - Add support for sensor query info (clocks, temp, etc).
  64  * - 3.12.0 - Add query for double offchip LDS buffers
  65  * - 3.13.0 - Add PRT support
  66  * - 3.14.0 - Fix race in amdgpu_ctx_get_fence() and note new functionality
  67  * - 3.15.0 - Export more gpu info for gfx9
  68  * - 3.16.0 - Add reserved vmid support
  69  * - 3.17.0 - Add AMDGPU_NUM_VRAM_CPU_PAGE_FAULTS.
  70  */
  71 #define KMS_DRIVER_MAJOR        3
  72 #define KMS_DRIVER_MINOR        17
  73 #define KMS_DRIVER_PATCHLEVEL   0
  74
  75 int amdgpu_vram_limit = 0;
  76 int amdgpu_gart_size = -1; /* auto */
  77 int amdgpu_moverate = -1; /* auto */
  78 int amdgpu_benchmarking = 0;
  79 int amdgpu_testing = 0;
  80 int amdgpu_audio = -1;
  81 int amdgpu_disp_priority = 0;
  82 int amdgpu_hw_i2c = 0;
  83 int amdgpu_pcie_gen2 = -1;
  84 int amdgpu_msi = -1;
  85 int amdgpu_lockup_timeout = 0;
  86 int amdgpu_dpm = -1;
  87 int amdgpu_fw_load_type = -1;
  88 int amdgpu_aspm = -1;
  89 int amdgpu_runtime_pm = -1;
  90 unsigned amdgpu_ip_block_mask = 0xffffffff;
  91 int amdgpu_bapm = -1;
  92 int amdgpu_deep_color = 0;
  93 int amdgpu_vm_size = -1;
  94 int amdgpu_vm_block_size = -1;
  95 int amdgpu_vm_fault_stop = 0;
  96 int amdgpu_vm_debug = 0;
  97 int amdgpu_vram_page_split = 512;
  98 int amdgpu_vm_update_mode = -1;
  99 int amdgpu_exp_hw_support = 0;
 100 int amdgpu_sched_jobs = 32;
 101 int amdgpu_sched_hw_submission = 2;
 102 int amdgpu_no_evict = 0;
 103 int amdgpu_direct_gma_size = 0;
 104 unsigned amdgpu_pcie_gen_cap = 0;
 105 unsigned amdgpu_pcie_lane_cap = 0;
 106 unsigned amdgpu_cg_mask = 0xffffffff;
 107 unsigned amdgpu_pg_mask = 0xffffffff;
 108 char *amdgpu_disable_cu = NULL;
 109 char *amdgpu_virtual_display = NULL;
 110 unsigned amdgpu_pp_feature_mask = 0xffffffff;
 111 int amdgpu_ngg = 0;
 112 int amdgpu_prim_buf_per_se = 0;
 113 int amdgpu_pos_buf_per_se = 0;
 114 int amdgpu_cntl_sb_buf_per_se = 0;
 115 int amdgpu_param_buf_per_se = 0;
 116 int amdgpu_job_hang_limit = 0;
 117 int amdgpu_lbpw = -1;
 118
 119 MODULE_PARM_DESC(vramlimit, "Restrict VRAM for testing, in megabytes");
 120 module_param_named(vramlimit, amdgpu_vram_limit, int, 0600);
 121
 122 MODULE_PARM_DESC(gartsize, "Size of PCIE/IGP gart to setup in megabytes (32, 64, etc., -1 = auto)");
 123 module_param_named(gartsize, amdgpu_gart_size, int, 0600);
 124
 125 MODULE_PARM_DESC(moverate, "Maximum buffer migration rate in MB/s. (32, 64, etc., -1=auto, 0=1=disabled)");
 126 module_param_named(moverate, amdgpu_moverate, int, 0600);
 127
 128 MODULE_PARM_DESC(benchmark, "Run benchmark");
 129 module_param_named(benchmark, amdgpu_benchmarking, int, 0444);
 130
 131 MODULE_PARM_DESC(test, "Run tests");
 132 module_param_named(test, amdgpu_testing, int, 0444);
 133
 134 MODULE_PARM_DESC(audio, "Audio enable (-1 = auto, 0 = disable, 1 = enable)");
 135 module_param_named(audio, amdgpu_audio, int, 0444);
 136
 137 MODULE_PARM_DESC(disp_priority, "Display Priority (0 = auto, 1 = normal, 2 = high)");
 138 module_param_named(disp_priority, amdgpu_disp_priority, int, 0444);
 139
 140 MODULE_PARM_DESC(hw_i2c, "hw i2c engine enable (0 = disable)");
 141 module_param_named(hw_i2c, amdgpu_hw_i2c, int, 0444);
 142
 143 MODULE_PARM_DESC(pcie_gen2, "PCIE Gen2 mode (-1 = auto, 0 = disable, 1 = enable)");
 144 module_param_named(pcie_gen2, amdgpu_pcie_gen2, int, 0444);
 145
 146 MODULE_PARM_DESC(msi, "MSI support (1 = enable, 0 = disable, -1 = auto)");
 147 module_param_named(msi, amdgpu_msi, int, 0444);
 148
 149 MODULE_PARM_DESC(lockup_timeout, "GPU lockup timeout in ms (default 0 = disable)");
 150 module_param_named(lockup_timeout, amdgpu_lockup_timeout, int, 0444);
 151
 152 MODULE_PARM_DESC(dpm, "DPM support (1 = enable, 0 = disable, -1 = auto)");
 153 module_param_named(dpm, amdgpu_dpm, int, 0444);
 154
 155 MODULE_PARM_DESC(fw_load_type, "firmware loading type (0 = direct, 1 = SMU, 2 = PSP, -1 = auto)");
 156 module_param_named(fw_load_type, amdgpu_fw_load_type, int, 0444);
 157
 158 MODULE_PARM_DESC(aspm, "ASPM support (1 = enable, 0 = disable, -1 = auto)");
 159 module_param_named(aspm, amdgpu_aspm, int, 0444);
 160
 161 MODULE_PARM_DESC(runpm, "PX runtime pm (1 = force enable, 0 = disable, -1 = PX only default)");
 162 module_param_named(runpm, amdgpu_runtime_pm, int, 0444);
 163
 164 MODULE_PARM_DESC(ip_block_mask, "IP Block Mask (all blocks enabled (default))");
 165 module_param_named(ip_block_mask, amdgpu_ip_block_mask, uint, 0444);
 166
 167 MODULE_PARM_DESC(bapm, "BAPM support (1 = enable, 0 = disable, -1 = auto)");
 168 module_param_named(bapm, amdgpu_bapm, int, 0444);
 169
 170 MODULE_PARM_DESC(deep_color, "Deep Color support (1 = enable, 0 = disable (default))");
 171 module_param_named(deep_color, amdgpu_deep_color, int, 0444);
 172
 173 MODULE_PARM_DESC(vm_size, "VM address space size in gigabytes (default 64GB)");
 174 module_param_named(vm_size, amdgpu_vm_size, int, 0444);
 175
 176 MODULE_PARM_DESC(vm_block_size, "VM page table size in bits (default depending on vm_size)");
 177 module_param_named(vm_block_size, amdgpu_vm_block_size, int, 0444);
 178
 179 MODULE_PARM_DESC(vm_fault_stop, "Stop on VM fault (0 = never (default), 1 = print first, 2 = always)");
 180 module_param_named(vm_fault_stop, amdgpu_vm_fault_stop, int, 0444);
 181
 182 MODULE_PARM_DESC(vm_debug, "Debug VM handling (0 = disabled (default), 1 = enabled)");
 183 module_param_named(vm_debug, amdgpu_vm_debug, int, 0644);
 184
 185 MODULE_PARM_DESC(vm_update_mode, "VM update using CPU (0 = never (default except for large BAR(LB)), 1 = Graphics only, 2 = Compute only (default for LB), 3 = Both");
 186 module_param_named(vm_update_mode, amdgpu_vm_update_mode, int, 0444);
 187
 188 MODULE_PARM_DESC(vram_page_split, "Number of pages after we split VRAM allocations (default 1024, -1 = disable)");
 189 module_param_named(vram_page_split, amdgpu_vram_page_split, int, 0444);
 190
 191 MODULE_PARM_DESC(exp_hw_support, "experimental hw support (1 = enable, 0 = disable (default))");
 192 module_param_named(exp_hw_support, amdgpu_exp_hw_support, int, 0444);
 193
 194 MODULE_PARM_DESC(sched_jobs, "the max number of jobs supported in the sw queue (default 32)");
 195 module_param_named(sched_jobs, amdgpu_sched_jobs, int, 0444);
 196
 197 MODULE_PARM_DESC(sched_hw_submission, "the max number of HW submissions (default 2)");
 198 module_param_named(sched_hw_submission, amdgpu_sched_hw_submission, int, 0444);
 199
 200 MODULE_PARM_DESC(ppfeaturemask, "all power features enabled (default))");
 201 module_param_named(ppfeaturemask, amdgpu_pp_feature_mask, int, 0444);
 202
 203 MODULE_PARM_DESC(no_evict, "Support pinning request from user space (1 = enable, 0 = disable (default))");
 204 module_param_named(no_evict, amdgpu_no_evict, int, 0444);
 205
 206 MODULE_PARM_DESC(direct_gma_size, "Direct GMA size in megabytes (max 96MB)");
 207 module_param_named(direct_gma_size, amdgpu_direct_gma_size, int, 0444);
 208
 209 MODULE_PARM_DESC(pcie_gen_cap, "PCIE Gen Caps (0: autodetect (default))");
 210 module_param_named(pcie_gen_cap, amdgpu_pcie_gen_cap, uint, 0444);
 211
 212 MODULE_PARM_DESC(pcie_lane_cap, "PCIE Lane Caps (0: autodetect (default))");
 213 module_param_named(pcie_lane_cap, amdgpu_pcie_lane_cap, uint, 0444);
 214
 215 MODULE_PARM_DESC(cg_mask, "Clockgating flags mask (0 = disable clock gating)");
 216 module_param_named(cg_mask, amdgpu_cg_mask, uint, 0444);
 217
 218 MODULE_PARM_DESC(pg_mask, "Powergating flags mask (0 = disable power gating)");
 219 module_param_named(pg_mask, amdgpu_pg_mask, uint, 0444);
 220
 221 MODULE_PARM_DESC(disable_cu, "Disable CUs (se.sh.cu,...)");
 222 module_param_named(disable_cu, amdgpu_disable_cu, charp, 0444);
 223
 224 MODULE_PARM_DESC(virtual_display,
 225                  "Enable virtual display feature (the virtual_display will be set like xxxx:xx:xx.x,x;xxxx:xx:xx.x,x)");
 226 module_param_named(virtual_display, amdgpu_virtual_display, charp, 0444);
 227
 228 MODULE_PARM_DESC(ngg, "Next Generation Graphics (1 = enable, 0 = disable(default depending on gfx))");
 229 module_param_named(ngg, amdgpu_ngg, int, 0444);
 230
 231 MODULE_PARM_DESC(prim_buf_per_se, "the size of Primitive Buffer per Shader Engine (default depending on gfx)");
 232 module_param_named(prim_buf_per_se, amdgpu_prim_buf_per_se, int, 0444);
 233
 234 MODULE_PARM_DESC(pos_buf_per_se, "the size of Position Buffer per Shader Engine (default depending on gfx)");
 235 module_param_named(pos_buf_per_se, amdgpu_pos_buf_per_se, int, 0444);
 236
 237 MODULE_PARM_DESC(cntl_sb_buf_per_se, "the size of Control Sideband per Shader Engine (default depending on gfx)");
 238 module_param_named(cntl_sb_buf_per_se, amdgpu_cntl_sb_buf_per_se, int, 0444);
 239
 240 MODULE_PARM_DESC(param_buf_per_se, "the size of Off-Chip Pramater Cache per Shader Engine (default depending on gfx)");
 241 module_param_named(param_buf_per_se, amdgpu_param_buf_per_se, int, 0444);
 242
 243 MODULE_PARM_DESC(job_hang_limit, "how much time allow a job hang and not drop it (default 0)");
 244 module_param_named(job_hang_limit, amdgpu_job_hang_limit, int ,0444);
 245
 246 MODULE_PARM_DESC(lbpw, "Load Balancing Per Watt (LBPW) support (1 = enable, 0 = disable, -1 = auto)");
 247 module_param_named(lbpw, amdgpu_lbpw, int, 0444);
 248
 249 #ifdef CONFIG_DRM_AMDGPU_SI
 250 int amdgpu_si_support = 0;
 251 MODULE_PARM_DESC(si_support, "SI support (1 = enabled, 0 = disabled (default))");
 252 module_param_named(si_support, amdgpu_si_support, int, 0444);
 253 #endif
 254
 255 #ifdef CONFIG_DRM_AMDGPU_CIK
 256 int amdgpu_cik_support = 0;
 257 MODULE_PARM_DESC(cik_support, "CIK support (1 = enabled, 0 = disabled (default))");
 258 module_param_named(cik_support, amdgpu_cik_support, int, 0444);
 259 #endif
 260
 261
 262 static const struct pci_device_id pciidlist[] = {
 263 #ifdef  CONFIG_DRM_AMDGPU_SI
 264         {0x1002, 0x6780, PCI_ANY_ID, PCI_ANY_ID, 0, 0, CHIP_TAHITI},
 265         {0x1002, 0x6784, PCI_ANY_ID, PCI_ANY_ID, 0, 0, CHIP_TAHITI},
 266         {0x1002, 0x6788, PCI_ANY_ID, PCI_ANY_ID, 0, 0, CHIP_TAHITI},
 267         {0x1002, 0x678A, PCI_ANY_ID, PCI_ANY_ID, 0, 0, CHIP_TAHITI},
 268         {0x1002, 0x6790, PCI_ANY_ID, PCI_ANY_ID, 0, 0, CHIP_TAHITI},
 269         {0x1002, 0x6791, PCI_ANY_ID, PCI_ANY_ID, 0, 0, CHIP_TAHITI},
 270         {0x1002, 0x6792, PCI_ANY_ID, PCI_ANY_ID, 0, 0, CHIP_TAHITI},
 271         {0x1002, 0x6798, PCI_ANY_ID, PCI_ANY_ID, 0, 0, CHIP_TAHITI},
 272         {0x1002, 0x6799, PCI_ANY_ID, PCI_ANY_ID, 0, 0, CHIP_TAHITI},
 273         {0x1002, 0x679A, PCI_ANY_ID, PCI_ANY_ID, 0, 0, CHIP_TAHITI},
 274         {0x1002, 0x679B, PCI_ANY_ID, PCI_ANY_ID, 0, 0, CHIP_TAHITI},
 275         {0x1002, 0x679E, PCI_ANY_ID, PCI_ANY_ID, 0, 0, CHIP_TAHITI},
 276         {0x1002, 0x679F, PCI_ANY_ID, PCI_ANY_ID, 0, 0, CHIP_TAHITI},
 277         {0x1002, 0x6800, PCI_ANY_ID, PCI_ANY_ID, 0, 0, CHIP_PITCAIRN|AMD_IS_MOBILITY},
 278         {0x1002, 0x6801, PCI_ANY_ID, PCI_ANY_ID, 0, 0, CHIP_PITCAIRN|AMD_IS_MOBILITY},
 279         {0x1002, 0x6802, PCI_ANY_ID, PCI_ANY_ID, 0, 0, CHIP_PITCAIRN|AMD_IS_MOBILITY},
 280         {0x1002, 0x6806, PCI_ANY_ID, PCI_ANY_ID, 0, 0, CHIP_PITCAIRN},
 281         {0x1002, 0x6808, PCI_ANY_ID, PCI_ANY_ID, 0, 0, CHIP_PITCAIRN},
 282         {0x1002, 0x6809, PCI_ANY_ID, PCI_ANY_ID, 0, 0, CHIP_PITCAIRN},
 283         {0x1002, 0x6810, PCI_ANY_ID, PCI_ANY_ID, 0, 0, CHIP_PITCAIRN},
 284         {0x1002, 0x6811, PCI_ANY_ID, PCI_ANY_ID, 0, 0, CHIP_PITCAIRN},
 285         {0x1002, 0x6816, PCI_ANY_ID, PCI_ANY_ID, 0, 0, CHIP_PITCAIRN},
 286         {0x1002, 0x6817, PCI_ANY_ID, PCI_ANY_ID, 0, 0, CHIP_PITCAIRN},
 287         {0x1002, 0x6818, PCI_ANY_ID, PCI_ANY_ID, 0, 0, CHIP_PITCAIRN},
 288         {0x1002, 0x6819, PCI_ANY_ID, PCI_ANY_ID, 0, 0, CHIP_PITCAIRN},
 289         {0x1002, 0x6600, PCI_ANY_ID, PCI_ANY_ID, 0, 0, CHIP_OLAND|AMD_IS_MOBILITY},
 290         {0x1002, 0x6601, PCI_ANY_ID, PCI_ANY_ID, 0, 0, CHIP_OLAND|AMD_IS_MOBILITY},
 291         {0x1002, 0x6602, PCI_ANY_ID, PCI_ANY_ID, 0, 0, CHIP_OLAND|AMD_IS_MOBILITY},
 292         {0x1002, 0x6603, PCI_ANY_ID, PCI_ANY_ID, 0, 0, CHIP_OLAND|AMD_IS_MOBILITY},
 293         {0x1002, 0x6604, PCI_ANY_ID, PCI_ANY_ID, 0, 0, CHIP_OLAND|AMD_IS_MOBILITY},
 294         {0x1002, 0x6605, PCI_ANY_ID, PCI_ANY_ID, 0, 0, CHIP_OLAND|AMD_IS_MOBILITY},
 295         {0x1002, 0x6606, PCI_ANY_ID, PCI_ANY_ID, 0, 0, CHIP_OLAND|AMD_IS_MOBILITY},
 296         {0x1002, 0x6607, PCI_ANY_ID, PCI_ANY_ID, 0, 0, CHIP_OLAND|AMD_IS_MOBILITY},
 297         {0x1002, 0x6608, PCI_ANY_ID, PCI_ANY_ID, 0, 0, CHIP_OLAND},
 298         {0x1002, 0x6610, PCI_ANY_ID, PCI_ANY_ID, 0, 0, CHIP_OLAND},
 299         {0x1002, 0x6611, PCI_ANY_ID, PCI_ANY_ID, 0, 0, CHIP_OLAND},
 300         {0x1002, 0x6613, PCI_ANY_ID, PCI_ANY_ID, 0, 0, CHIP_OLAND},
 301         {0x1002, 0x6617, PCI_ANY_ID, PCI_ANY_ID, 0, 0, CHIP_OLAND|AMD_IS_MOBILITY},
 302         {0x1002, 0x6620, PCI_ANY_ID, PCI_ANY_ID, 0, 0, CHIP_OLAND|AMD_IS_MOBILITY},
 303         {0x1002, 0x6621, PCI_ANY_ID, PCI_ANY_ID, 0, 0, CHIP_OLAND|AMD_IS_MOBILITY},
 304         {0x1002, 0x6623, PCI_ANY_ID, PCI_ANY_ID, 0, 0, CHIP_OLAND|AMD_IS_MOBILITY},
 305         {0x1002, 0x6631, PCI_ANY_ID, PCI_ANY_ID, 0, 0, CHIP_OLAND},
 306         {0x1002, 0x6820, PCI_ANY_ID, PCI_ANY_ID, 0, 0, CHIP_VERDE|AMD_IS_MOBILITY},
 307         {0x1002, 0x6821, PCI_ANY_ID, PCI_ANY_ID, 0, 0, CHIP_VERDE|AMD_IS_MOBILITY},
 308         {0x1002, 0x6822, PCI_ANY_ID, PCI_ANY_ID, 0, 0, CHIP_VERDE|AMD_IS_MOBILITY},
 309         {0x1002, 0x6823, PCI_ANY_ID, PCI_ANY_ID, 0, 0, CHIP_VERDE|AMD_IS_MOBILITY},
 310         {0x1002, 0x6824, PCI_ANY_ID, PCI_ANY_ID, 0, 0, CHIP_VERDE|AMD_IS_MOBILITY},
 311         {0x1002, 0x6825, PCI_ANY_ID, PCI_ANY_ID, 0, 0, CHIP_VERDE|AMD_IS_MOBILITY},
 312         {0x1002, 0x6826, PCI_ANY_ID, PCI_ANY_ID, 0, 0, CHIP_VERDE|AMD_IS_MOBILITY},
 313         {0x1002, 0x6827, PCI_ANY_ID, PCI_ANY_ID, 0, 0, CHIP_VERDE|AMD_IS_MOBILITY},
 314         {0x1002, 0x6828, PCI_ANY_ID, PCI_ANY_ID, 0, 0, CHIP_VERDE},
 315         {0x1002, 0x6829, PCI_ANY_ID, PCI_ANY_ID, 0, 0, CHIP_VERDE},
 316         {0x1002, 0x682A, PCI_ANY_ID, PCI_ANY_ID, 0, 0, CHIP_VERDE|AMD_IS_MOBILITY},
 317         {0x1002, 0x682B, PCI_ANY_ID, PCI_ANY_ID, 0, 0, CHIP_VERDE|AMD_IS_MOBILITY},
 318         {0x1002, 0x682C, PCI_ANY_ID, PCI_ANY_ID, 0, 0, CHIP_VERDE},
 319         {0x1002, 0x682D, PCI_ANY_ID, PCI_ANY_ID, 0, 0, CHIP_VERDE|AMD_IS_MOBILITY},
 320         {0x1002, 0x682F, PCI_ANY_ID, PCI_ANY_ID, 0, 0, CHIP_VERDE|AMD_IS_MOBILITY},
 321         {0x1002, 0x6830, PCI_ANY_ID, PCI_ANY_ID, 0, 0, CHIP_VERDE|AMD_IS_MOBILITY},
 322         {0x1002, 0x6831, PCI_ANY_ID, PCI_ANY_ID, 0, 0, CHIP_VERDE|AMD_IS_MOBILITY},
 323         {0x1002, 0x6835, PCI_ANY_ID, PCI_ANY_ID, 0, 0, CHIP_VERDE},
 324         {0x1002, 0x6837, PCI_ANY_ID, PCI_ANY_ID, 0, 0, CHIP_VERDE},
 325         {0x1002, 0x6838, PCI_ANY_ID, PCI_ANY_ID, 0, 0, CHIP_VERDE},
 326         {0x1002, 0x6839, PCI_ANY_ID, PCI_ANY_ID, 0, 0, CHIP_VERDE},
 327         {0x1002, 0x683B, PCI_ANY_ID, PCI_ANY_ID, 0, 0, CHIP_VERDE},
 328         {0x1002, 0x683D, PCI_ANY_ID, PCI_ANY_ID, 0, 0, CHIP_VERDE},
 329         {0x1002, 0x683F, PCI_ANY_ID, PCI_ANY_ID, 0, 0, CHIP_VERDE},
 330         {0x1002, 0x6660, PCI_ANY_ID, PCI_ANY_ID, 0, 0, CHIP_HAINAN|AMD_IS_MOBILITY},
 331         {0x1002, 0x6663, PCI_ANY_ID, PCI_ANY_ID, 0, 0, CHIP_HAINAN|AMD_IS_MOBILITY},
 332         {0x1002, 0x6664, PCI_ANY_ID, PCI_ANY_ID, 0, 0, CHIP_HAINAN|AMD_IS_MOBILITY},
 333         {0x1002, 0x6665, PCI_ANY_ID, PCI_ANY_ID, 0, 0, CHIP_HAINAN|AMD_IS_MOBILITY},
 334         {0x1002, 0x6667, PCI_ANY_ID, PCI_ANY_ID, 0, 0, CHIP_HAINAN|AMD_IS_MOBILITY},
 335         {0x1002, 0x666F, PCI_ANY_ID, PCI_ANY_ID, 0, 0, CHIP_HAINAN|AMD_IS_MOBILITY},
 336 #endif
 337 #ifdef CONFIG_DRM_AMDGPU_CIK
 338         /* Kaveri */
 339         {0x1002, 0x1304, PCI_ANY_ID, PCI_ANY_ID, 0, 0, CHIP_KAVERI|AMD_IS_MOBILITY|AMD_IS_APU},
 340         {0x1002, 0x1305, PCI_ANY_ID, PCI_ANY_ID, 0, 0, CHIP_KAVERI|AMD_IS_APU},
 341         {0x1002, 0x1306, PCI_ANY_ID, PCI_ANY_ID, 0, 0, CHIP_KAVERI|AMD_IS_MOBILITY|AMD_IS_APU},
 342         {0x1002, 0x1307, PCI_ANY_ID, PCI_ANY_ID, 0, 0, CHIP_KAVERI|AMD_IS_APU},
 343         {0x1002, 0x1309, PCI_ANY_ID, PCI_ANY_ID, 0, 0, CHIP_KAVERI|AMD_IS_MOBILITY|AMD_IS_APU},
 344         {0x1002, 0x130A, PCI_ANY_ID, PCI_ANY_ID, 0, 0, CHIP_KAVERI|AMD_IS_MOBILITY|AMD_IS_APU},
 345         {0x1002, 0x130B, PCI_ANY_ID, PCI_ANY_ID, 0, 0, CHIP_KAVERI|AMD_IS_MOBILITY|AMD_IS_APU},
 346         {0x1002, 0x130C, PCI_ANY_ID, PCI_ANY_ID, 0, 0, CHIP_KAVERI|AMD_IS_MOBILITY|AMD_IS_APU},
 347         {0x1002, 0x130D, PCI_ANY_ID, PCI_ANY_ID, 0, 0, CHIP_KAVERI|AMD_IS_MOBILITY|AMD_IS_APU},
 348         {0x1002, 0x130E, PCI_ANY_ID, PCI_ANY_ID, 0, 0, CHIP_KAVERI|AMD_IS_MOBILITY|AMD_IS_APU},
 349         {0x1002, 0x130F, PCI_ANY_ID, PCI_ANY_ID, 0, 0, CHIP_KAVERI|AMD_IS_APU},
 350         {0x1002, 0x1310, PCI_ANY_ID, PCI_ANY_ID, 0, 0, CHIP_KAVERI|AMD_IS_APU},
 351         {0x1002, 0x1311, PCI_ANY_ID, PCI_ANY_ID, 0, 0, CHIP_KAVERI|AMD_IS_APU},
 352         {0x1002, 0x1312, PCI_ANY_ID, PCI_ANY_ID, 0, 0, CHIP_KAVERI|AMD_IS_APU},
 353         {0x1002, 0x1313, PCI_ANY_ID, PCI_ANY_ID, 0, 0, CHIP_KAVERI|AMD_IS_APU},
 354         {0x1002, 0x1315, PCI_ANY_ID, PCI_ANY_ID, 0, 0, CHIP_KAVERI|AMD_IS_APU},
 355         {0x1002, 0x1316, PCI_ANY_ID, PCI_ANY_ID, 0, 0, CHIP_KAVERI|AMD_IS_APU},
 356         {0x1002, 0x1317, PCI_ANY_ID, PCI_ANY_ID, 0, 0, CHIP_KAVERI|AMD_IS_MOBILITY|AMD_IS_APU},
 357         {0x1002, 0x1318, PCI_ANY_ID, PCI_ANY_ID, 0, 0, CHIP_KAVERI|AMD_IS_MOBILITY|AMD_IS_APU},
 358         {0x1002, 0x131B, PCI_ANY_ID, PCI_ANY_ID, 0, 0, CHIP_KAVERI|AMD_IS_APU},
 359         {0x1002, 0x131C, PCI_ANY_ID, PCI_ANY_ID, 0, 0, CHIP_KAVERI|AMD_IS_APU},
 360         {0x1002, 0x131D, PCI_ANY_ID, PCI_ANY_ID, 0, 0, CHIP_KAVERI|AMD_IS_APU},
 361         /* Bonaire */
 362         {0x1002, 0x6640, PCI_ANY_ID, PCI_ANY_ID, 0, 0, CHIP_BONAIRE|AMD_IS_MOBILITY},
 363         {0x1002, 0x6641, PCI_ANY_ID, PCI_ANY_ID, 0, 0, CHIP_BONAIRE|AMD_IS_MOBILITY},
 364         {0x1002, 0x6646, PCI_ANY_ID, PCI_ANY_ID, 0, 0, CHIP_BONAIRE|AMD_IS_MOBILITY},
 365         {0x1002, 0x6647, PCI_ANY_ID, PCI_ANY_ID, 0, 0, CHIP_BONAIRE|AMD_IS_MOBILITY},
 366         {0x1002, 0x6649, PCI_ANY_ID, PCI_ANY_ID, 0, 0, CHIP_BONAIRE},
 367         {0x1002, 0x6650, PCI_ANY_ID, PCI_ANY_ID, 0, 0, CHIP_BONAIRE},
 368         {0x1002, 0x6651, PCI_ANY_ID, PCI_ANY_ID, 0, 0, CHIP_BONAIRE},
 369         {0x1002, 0x6658, PCI_ANY_ID, PCI_ANY_ID, 0, 0, CHIP_BONAIRE},
 370         {0x1002, 0x665c, PCI_ANY_ID, PCI_ANY_ID, 0, 0, CHIP_BONAIRE},
 371         {0x1002, 0x665d, PCI_ANY_ID, PCI_ANY_ID, 0, 0, CHIP_BONAIRE},
 372         {0x1002, 0x665f, PCI_ANY_ID, PCI_ANY_ID, 0, 0, CHIP_BONAIRE},
 373         /* Hawaii */
 374         {0x1002, 0x67A0, PCI_ANY_ID, PCI_ANY_ID, 0, 0, CHIP_HAWAII},
 375         {0x1002, 0x67A1, PCI_ANY_ID, PCI_ANY_ID, 0, 0, CHIP_HAWAII},
 376         {0x1002, 0x67A2, PCI_ANY_ID, PCI_ANY_ID, 0, 0, CHIP_HAWAII},
 377         {0x1002, 0x67A8, PCI_ANY_ID, PCI_ANY_ID, 0, 0, CHIP_HAWAII},
 378         {0x1002, 0x67A9, PCI_ANY_ID, PCI_ANY_ID, 0, 0, CHIP_HAWAII},
 379         {0x1002, 0x67AA, PCI_ANY_ID, PCI_ANY_ID, 0, 0, CHIP_HAWAII},
 380         {0x1002, 0x67B0, PCI_ANY_ID, PCI_ANY_ID, 0, 0, CHIP_HAWAII},
 381         {0x1002, 0x67B1, PCI_ANY_ID, PCI_ANY_ID, 0, 0, CHIP_HAWAII},
 382         {0x1002, 0x67B8, PCI_ANY_ID, PCI_ANY_ID, 0, 0, CHIP_HAWAII},
 383         {0x1002, 0x67B9, PCI_ANY_ID, PCI_ANY_ID, 0, 0, CHIP_HAWAII},
 384         {0x1002, 0x67BA, PCI_ANY_ID, PCI_ANY_ID, 0, 0, CHIP_HAWAII},
 385         {0x1002, 0x67BE, PCI_ANY_ID, PCI_ANY_ID, 0, 0, CHIP_HAWAII},
 386         /* Kabini */
 387         {0x1002, 0x9830, PCI_ANY_ID, PCI_ANY_ID, 0, 0, CHIP_KABINI|AMD_IS_MOBILITY|AMD_IS_APU},
 388         {0x1002, 0x9831, PCI_ANY_ID, PCI_ANY_ID, 0, 0, CHIP_KABINI|AMD_IS_APU},
 389         {0x1002, 0x9832, PCI_ANY_ID, PCI_ANY_ID, 0, 0, CHIP_KABINI|AMD_IS_MOBILITY|AMD_IS_APU},
 390         {0x1002, 0x9833, PCI_ANY_ID, PCI_ANY_ID, 0, 0, CHIP_KABINI|AMD_IS_APU},
 391         {0x1002, 0x9834, PCI_ANY_ID, PCI_ANY_ID, 0, 0, CHIP_KABINI|AMD_IS_MOBILITY|AMD_IS_APU},
 392         {0x1002, 0x9835, PCI_ANY_ID, PCI_ANY_ID, 0, 0, CHIP_KABINI|AMD_IS_APU},
 393         {0x1002, 0x9836, PCI_ANY_ID, PCI_ANY_ID, 0, 0, CHIP_KABINI|AMD_IS_MOBILITY|AMD_IS_APU},
 394         {0x1002, 0x9837, PCI_ANY_ID, PCI_ANY_ID, 0, 0, CHIP_KABINI|AMD_IS_APU},
 395         {0x1002, 0x9838, PCI_ANY_ID, PCI_ANY_ID, 0, 0, CHIP_KABINI|AMD_IS_MOBILITY|AMD_IS_APU},
 396         {0x1002, 0x9839, PCI_ANY_ID, PCI_ANY_ID, 0, 0, CHIP_KABINI|AMD_IS_MOBILITY|AMD_IS_APU},
 397         {0x1002, 0x983a, PCI_ANY_ID, PCI_ANY_ID, 0, 0, CHIP_KABINI|AMD_IS_APU},
 398         {0x1002, 0x983b, PCI_ANY_ID, PCI_ANY_ID, 0, 0, CHIP_KABINI|AMD_IS_MOBILITY|AMD_IS_APU},
 399         {0x1002, 0x983c, PCI_ANY_ID, PCI_ANY_ID, 0, 0, CHIP_KABINI|AMD_IS_APU},
 400         {0x1002, 0x983d, PCI_ANY_ID, PCI_ANY_ID, 0, 0, CHIP_KABINI|AMD_IS_APU},
 401         {0x1002, 0x983e, PCI_ANY_ID, PCI_ANY_ID, 0, 0, CHIP_KABINI|AMD_IS_APU},
 402         {0x1002, 0x983f, PCI_ANY_ID, PCI_ANY_ID, 0, 0, CHIP_KABINI|AMD_IS_APU},
 403         /* mullins */
 404         {0x1002, 0x9850, PCI_ANY_ID, PCI_ANY_ID, 0, 0, CHIP_MULLINS|AMD_IS_MOBILITY|AMD_IS_APU},
 405         {0x1002, 0x9851, PCI_ANY_ID, PCI_ANY_ID, 0, 0, CHIP_MULLINS|AMD_IS_MOBILITY|AMD_IS_APU},
 406         {0x1002, 0x9852, PCI_ANY_ID, PCI_ANY_ID, 0, 0, CHIP_MULLINS|AMD_IS_MOBILITY|AMD_IS_APU},
 407         {0x1002, 0x9853, PCI_ANY_ID, PCI_ANY_ID, 0, 0, CHIP_MULLINS|AMD_IS_MOBILITY|AMD_IS_APU},
 408         {0x1002, 0x9854, PCI_ANY_ID, PCI_ANY_ID, 0, 0, CHIP_MULLINS|AMD_IS_MOBILITY|AMD_IS_APU},
 409         {0x1002, 0x9855, PCI_ANY_ID, PCI_ANY_ID, 0, 0, CHIP_MULLINS|AMD_IS_MOBILITY|AMD_IS_APU},
 410         {0x1002, 0x9856, PCI_ANY_ID, PCI_ANY_ID, 0, 0, CHIP_MULLINS|AMD_IS_MOBILITY|AMD_IS_APU},
 411         {0x1002, 0x9857, PCI_ANY_ID, PCI_ANY_ID, 0, 0, CHIP_MULLINS|AMD_IS_MOBILITY|AMD_IS_APU},
 412         {0x1002, 0x9858, PCI_ANY_ID, PCI_ANY_ID, 0, 0, CHIP_MULLINS|AMD_IS_MOBILITY|AMD_IS_APU},
 413         {0x1002, 0x9859, PCI_ANY_ID, PCI_ANY_ID, 0, 0, CHIP_MULLINS|AMD_IS_MOBILITY|AMD_IS_APU},
 414         {0x1002, 0x985A, PCI_ANY_ID, PCI_ANY_ID, 0, 0, CHIP_MULLINS|AMD_IS_MOBILITY|AMD_IS_APU},
 415         {0x1002, 0x985B, PCI_ANY_ID, PCI_ANY_ID, 0, 0, CHIP_MULLINS|AMD_IS_MOBILITY|AMD_IS_APU},
 416         {0x1002, 0x985C, PCI_ANY_ID, PCI_ANY_ID, 0, 0, CHIP_MULLINS|AMD_IS_MOBILITY|AMD_IS_APU},
 417         {0x1002, 0x985D, PCI_ANY_ID, PCI_ANY_ID, 0, 0, CHIP_MULLINS|AMD_IS_MOBILITY|AMD_IS_APU},
 418         {0x1002, 0x985E, PCI_ANY_ID, PCI_ANY_ID, 0, 0, CHIP_MULLINS|AMD_IS_MOBILITY|AMD_IS_APU},
 419         {0x1002, 0x985F, PCI_ANY_ID, PCI_ANY_ID, 0, 0, CHIP_MULLINS|AMD_IS_MOBILITY|AMD_IS_APU},
 420 #endif
 421         /* topaz */
 422         {0x1002, 0x6900, PCI_ANY_ID, PCI_ANY_ID, 0, 0, CHIP_TOPAZ},
 423         {0x1002, 0x6901, PCI_ANY_ID, PCI_ANY_ID, 0, 0, CHIP_TOPAZ},
 424         {0x1002, 0x6902, PCI_ANY_ID, PCI_ANY_ID, 0, 0, CHIP_TOPAZ},
 425         {0x1002, 0x6903, PCI_ANY_ID, PCI_ANY_ID, 0, 0, CHIP_TOPAZ},
 426         {0x1002, 0x6907, PCI_ANY_ID, PCI_ANY_ID, 0, 0, CHIP_TOPAZ},
 427         /* tonga */
 428         {0x1002, 0x6920, PCI_ANY_ID, PCI_ANY_ID, 0, 0, CHIP_TONGA},
 429         {0x1002, 0x6921, PCI_ANY_ID, PCI_ANY_ID, 0, 0, CHIP_TONGA},
 430         {0x1002, 0x6928, PCI_ANY_ID, PCI_ANY_ID, 0, 0, CHIP_TONGA},
 431         {0x1002, 0x6929, PCI_ANY_ID, PCI_ANY_ID, 0, 0, CHIP_TONGA},
 432         {0x1002, 0x692B, PCI_ANY_ID, PCI_ANY_ID, 0, 0, CHIP_TONGA},
 433         {0x1002, 0x692F, PCI_ANY_ID, PCI_ANY_ID, 0, 0, CHIP_TONGA},
 434         {0x1002, 0x6930, PCI_ANY_ID, PCI_ANY_ID, 0, 0, CHIP_TONGA},
 435         {0x1002, 0x6938, PCI_ANY_ID, PCI_ANY_ID, 0, 0, CHIP_TONGA},
 436         {0x1002, 0x6939, PCI_ANY_ID, PCI_ANY_ID, 0, 0, CHIP_TONGA},
 437         /* fiji */
 438         {0x1002, 0x7300, PCI_ANY_ID, PCI_ANY_ID, 0, 0, CHIP_FIJI},
 439         {0x1002, 0x730F, PCI_ANY_ID, PCI_ANY_ID, 0, 0, CHIP_FIJI},
 440         /* carrizo */
 441         {0x1002, 0x9870, PCI_ANY_ID, PCI_ANY_ID, 0, 0, CHIP_CARRIZO|AMD_IS_APU},
 442         {0x1002, 0x9874, PCI_ANY_ID, PCI_ANY_ID, 0, 0, CHIP_CARRIZO|AMD_IS_APU},
 443         {0x1002, 0x9875, PCI_ANY_ID, PCI_ANY_ID, 0, 0, CHIP_CARRIZO|AMD_IS_APU},
 444         {0x1002, 0x9876, PCI_ANY_ID, PCI_ANY_ID, 0, 0, CHIP_CARRIZO|AMD_IS_APU},
 445         {0x1002, 0x9877, PCI_ANY_ID, PCI_ANY_ID, 0, 0, CHIP_CARRIZO|AMD_IS_APU},
 446         /* stoney */
 447         {0x1002, 0x98E4, PCI_ANY_ID, PCI_ANY_ID, 0, 0, CHIP_STONEY|AMD_IS_APU},
 448         /* Polaris11 */
 449         {0x1002, 0x67E0, PCI_ANY_ID, PCI_ANY_ID, 0, 0, CHIP_POLARIS11},
 450         {0x1002, 0x67E3, PCI_ANY_ID, PCI_ANY_ID, 0, 0, CHIP_POLARIS11},
 451         {0x1002, 0x67E8, PCI_ANY_ID, PCI_ANY_ID, 0, 0, CHIP_POLARIS11},
 452         {0x1002, 0x67EB, PCI_ANY_ID, PCI_ANY_ID, 0, 0, CHIP_POLARIS11},
 453         {0x1002, 0x67EF, PCI_ANY_ID, PCI_ANY_ID, 0, 0, CHIP_POLARIS11},
 454         {0x1002, 0x67FF, PCI_ANY_ID, PCI_ANY_ID, 0, 0, CHIP_POLARIS11},
 455         {0x1002, 0x67E1, PCI_ANY_ID, PCI_ANY_ID, 0, 0, CHIP_POLARIS11},
 456         {0x1002, 0x67E7, PCI_ANY_ID, PCI_ANY_ID, 0, 0, CHIP_POLARIS11},
 457         {0x1002, 0x67E9, PCI_ANY_ID, PCI_ANY_ID, 0, 0, CHIP_POLARIS11},
 458         /* Polaris10 */
 459         {0x1002, 0x67C0, PCI_ANY_ID, PCI_ANY_ID, 0, 0, CHIP_POLARIS10},
 460         {0x1002, 0x67C1, PCI_ANY_ID, PCI_ANY_ID, 0, 0, CHIP_POLARIS10},
 461         {0x1002, 0x67C2, PCI_ANY_ID, PCI_ANY_ID, 0, 0, CHIP_POLARIS10},
 462         {0x1002, 0x67C4, PCI_ANY_ID, PCI_ANY_ID, 0, 0, CHIP_POLARIS10},
 463         {0x1002, 0x67C7, PCI_ANY_ID, PCI_ANY_ID, 0, 0, CHIP_POLARIS10},
 464         {0x1002, 0x67D0, PCI_ANY_ID, PCI_ANY_ID, 0, 0, CHIP_POLARIS10},
 465         {0x1002, 0x67DF, PCI_ANY_ID, PCI_ANY_ID, 0, 0, CHIP_POLARIS10},
 466         {0x1002, 0x67C8, PCI_ANY_ID, PCI_ANY_ID, 0, 0, CHIP_POLARIS10},
 467         {0x1002, 0x67C9, PCI_ANY_ID, PCI_ANY_ID, 0, 0, CHIP_POLARIS10},
 468         {0x1002, 0x67CA, PCI_ANY_ID, PCI_ANY_ID, 0, 0, CHIP_POLARIS10},
 469         {0x1002, 0x67CC, PCI_ANY_ID, PCI_ANY_ID, 0, 0, CHIP_POLARIS10},
 470         {0x1002, 0x67CF, PCI_ANY_ID, PCI_ANY_ID, 0, 0, CHIP_POLARIS10},
 471         /* Polaris12 */
 472         {0x1002, 0x6980, PCI_ANY_ID, PCI_ANY_ID, 0, 0, CHIP_POLARIS12},
 473         {0x1002, 0x6981, PCI_ANY_ID, PCI_ANY_ID, 0, 0, CHIP_POLARIS12},
 474         {0x1002, 0x6985, PCI_ANY_ID, PCI_ANY_ID, 0, 0, CHIP_POLARIS12},
 475         {0x1002, 0x6986, PCI_ANY_ID, PCI_ANY_ID, 0, 0, CHIP_POLARIS12},
 476         {0x1002, 0x6987, PCI_ANY_ID, PCI_ANY_ID, 0, 0, CHIP_POLARIS12},
 477         {0x1002, 0x6995, PCI_ANY_ID, PCI_ANY_ID, 0, 0, CHIP_POLARIS12},
 478         {0x1002, 0x699F, PCI_ANY_ID, PCI_ANY_ID, 0, 0, CHIP_POLARIS12},
 479         /* Vega 10 */
 480         {0x1002, 0x6860, PCI_ANY_ID, PCI_ANY_ID, 0, 0, CHIP_VEGA10|AMD_EXP_HW_SUPPORT},
 481         {0x1002, 0x6861, PCI_ANY_ID, PCI_ANY_ID, 0, 0, CHIP_VEGA10|AMD_EXP_HW_SUPPORT},
 482         {0x1002, 0x6862, PCI_ANY_ID, PCI_ANY_ID, 0, 0, CHIP_VEGA10|AMD_EXP_HW_SUPPORT},
 483         {0x1002, 0x6863, PCI_ANY_ID, PCI_ANY_ID, 0, 0, CHIP_VEGA10|AMD_EXP_HW_SUPPORT},
 484         {0x1002, 0x6864, PCI_ANY_ID, PCI_ANY_ID, 0, 0, CHIP_VEGA10|AMD_EXP_HW_SUPPORT},
 485         {0x1002, 0x6867, PCI_ANY_ID, PCI_ANY_ID, 0, 0, CHIP_VEGA10|AMD_EXP_HW_SUPPORT},
 486         {0x1002, 0x6868, PCI_ANY_ID, PCI_ANY_ID, 0, 0, CHIP_VEGA10|AMD_EXP_HW_SUPPORT},
 487         {0x1002, 0x686c, PCI_ANY_ID, PCI_ANY_ID, 0, 0, CHIP_VEGA10|AMD_EXP_HW_SUPPORT},
 488         {0x1002, 0x687f, PCI_ANY_ID, PCI_ANY_ID, 0, 0, CHIP_VEGA10|AMD_EXP_HW_SUPPORT},
 489         /* Raven */
 490         {0x1002, 0x15dd, PCI_ANY_ID, PCI_ANY_ID, 0, 0, CHIP_RAVEN|AMD_IS_APU|AMD_EXP_HW_SUPPORT},
 491
 492         {0, 0, 0}
 493 };
 494
 495 MODULE_DEVICE_TABLE(pci, pciidlist);
 496
 497 static struct drm_driver kms_driver;
 498
 499 static int amdgpu_kick_out_firmware_fb(struct pci_dev *pdev)
 500 {
 501         struct apertures_struct *ap;
 502         bool primary = false;
 503
 504         ap = alloc_apertures(1);
 505         if (!ap)
 506                 return -ENOMEM;
 507
 508         ap->ranges[0].base = pci_resource_start(pdev, 0);
 509         ap->ranges[0].size = pci_resource_len(pdev, 0);
 510
 511 #ifdef CONFIG_X86
 512         primary = pdev->resource[PCI_ROM_RESOURCE].flags & IORESOURCE_ROM_SHADOW;
 513 #endif
 514         drm_fb_helper_remove_conflicting_framebuffers(ap, "amdgpudrmfb", primary);
 515         kfree(ap);
 516
 517         return 0;
 518 }
 519
 520 static int amdgpu_pci_probe(struct pci_dev *pdev,
 521                             const struct pci_device_id *ent)
 522 {
 523         struct drm_device *dev;
 524         unsigned long flags = ent->driver_data;
 525         int ret;
 526
 527         if ((flags & AMD_EXP_HW_SUPPORT) && !amdgpu_exp_hw_support) {
 528                 DRM_INFO("This hardware requires experimental hardware support.\n"
 529                          "See modparam exp_hw_support\n");
 530                 return -ENODEV;
 531         }
 532
 533         /*
 534          * Initialize amdkfd before starting radeon. If it was not loaded yet,
 535          * defer radeon probing
 536          */
 537         ret = amdgpu_amdkfd_init();
 538         if (ret == -EPROBE_DEFER)
 539                 return ret;
 540
 541         /* Get rid of things like offb */
 542         ret = amdgpu_kick_out_firmware_fb(pdev);
 543         if (ret)
 544                 return ret;
 545
 546         dev = drm_dev_alloc(&kms_driver, &pdev->dev);
 547         if (IS_ERR(dev))
 548                 return PTR_ERR(dev);
 549
 550         ret = pci_enable_device(pdev);
 551         if (ret)
 552                 goto err_free;
 553
 554         dev->pdev = pdev;
 555
 556         pci_set_drvdata(pdev, dev);
 557
 558         ret = drm_dev_register(dev, ent->driver_data);
 559         if (ret)
 560                 goto err_pci;
 561
 562         return 0;
 563
 564 err_pci:
 565         pci_disable_device(pdev);
 566 err_free:
 567         drm_dev_unref(dev);
 568         return ret;
 569 }
 570
 571 static void
 572 amdgpu_pci_remove(struct pci_dev *pdev)
 573 {
 574         struct drm_device *dev = pci_get_drvdata(pdev);
 575
 576         drm_dev_unregister(dev);
 577         drm_dev_unref(dev);
 578 }
 579
 580 static void
 581 amdgpu_pci_shutdown(struct pci_dev *pdev)
 582 {
 583         struct drm_device *dev = pci_get_drvdata(pdev);
 584         struct amdgpu_device *adev = dev->dev_private;
 585
 586         /* if we are running in a VM, make sure the device
 587          * torn down properly on reboot/shutdown.
 588          * unfortunately we can't detect certain
 589          * hypervisors so just do this all the time.
 590          */
 591         amdgpu_suspend(adev);
 592 }
 593
 594 static int amdgpu_pmops_suspend(struct device *dev)
 595 {
 596         struct pci_dev *pdev = to_pci_dev(dev);
 597
 598         struct drm_device *drm_dev = pci_get_drvdata(pdev);
 599         return amdgpu_device_suspend(drm_dev, true, true);
 600 }
 601
 602 static int amdgpu_pmops_resume(struct device *dev)
 603 {
 604         struct pci_dev *pdev = to_pci_dev(dev);
 605         struct drm_device *drm_dev = pci_get_drvdata(pdev);
 606
 607         /* GPU comes up enabled by the bios on resume */
 608         if (amdgpu_device_is_px(drm_dev)) {
 609                 pm_runtime_disable(dev);
 610                 pm_runtime_set_active(dev);
 611                 pm_runtime_enable(dev);
 612         }
 613
 614         return amdgpu_device_resume(drm_dev, true, true);
 615 }
 616
 617 static int amdgpu_pmops_freeze(struct device *dev)
 618 {
 619         struct pci_dev *pdev = to_pci_dev(dev);
 620
 621         struct drm_device *drm_dev = pci_get_drvdata(pdev);
 622         return amdgpu_device_suspend(drm_dev, false, true);
 623 }
 624
 625 static int amdgpu_pmops_thaw(struct device *dev)
 626 {
 627         struct pci_dev *pdev = to_pci_dev(dev);
 628
 629         struct drm_device *drm_dev = pci_get_drvdata(pdev);
 630         return amdgpu_device_resume(drm_dev, false, true);
 631 }
 632
 633 static int amdgpu_pmops_poweroff(struct device *dev)
 634 {
 635         struct pci_dev *pdev = to_pci_dev(dev);
 636
 637         struct drm_device *drm_dev = pci_get_drvdata(pdev);
 638         return amdgpu_device_suspend(drm_dev, true, true);
 639 }
 640
 641 static int amdgpu_pmops_restore(struct device *dev)
 642 {
 643         struct pci_dev *pdev = to_pci_dev(dev);
 644
 645         struct drm_device *drm_dev = pci_get_drvdata(pdev);
 646         return amdgpu_device_resume(drm_dev, false, true);
 647 }
 648
 649 static int amdgpu_pmops_runtime_suspend(struct device *dev)
 650 {
 651         struct pci_dev *pdev = to_pci_dev(dev);
 652         struct drm_device *drm_dev = pci_get_drvdata(pdev);
 653         int ret;
 654
 655         if (!amdgpu_device_is_px(drm_dev)) {
 656                 pm_runtime_forbid(dev);
 657                 return -EBUSY;
 658         }
 659
 660         drm_dev->switch_power_state = DRM_SWITCH_POWER_CHANGING;
 661         drm_kms_helper_poll_disable(drm_dev);
 662         vga_switcheroo_set_dynamic_switch(pdev, VGA_SWITCHEROO_OFF);
 663
 664         ret = amdgpu_device_suspend(drm_dev, false, false);
 665         pci_save_state(pdev);
 666         pci_disable_device(pdev);
 667         pci_ignore_hotplug(pdev);
 668         if (amdgpu_is_atpx_hybrid())
 669                 pci_set_power_state(pdev, PCI_D3cold);
 670         else if (!amdgpu_has_atpx_dgpu_power_cntl())
 671                 pci_set_power_state(pdev, PCI_D3hot);
 672         drm_dev->switch_power_state = DRM_SWITCH_POWER_DYNAMIC_OFF;
 673
 674         return 0;
 675 }
 676
 677 static int amdgpu_pmops_runtime_resume(struct device *dev)
 678 {
 679         struct pci_dev *pdev = to_pci_dev(dev);
 680         struct drm_device *drm_dev = pci_get_drvdata(pdev);
 681         int ret;
 682
 683         if (!amdgpu_device_is_px(drm_dev))
 684                 return -EINVAL;
 685
 686         drm_dev->switch_power_state = DRM_SWITCH_POWER_CHANGING;
 687
 688         if (amdgpu_is_atpx_hybrid() ||
 689             !amdgpu_has_atpx_dgpu_power_cntl())
 690                 pci_set_power_state(pdev, PCI_D0);
 691         pci_restore_state(pdev);
 692         ret = pci_enable_device(pdev);
 693         if (ret)
 694                 return ret;
 695         pci_set_master(pdev);
 696
 697         ret = amdgpu_device_resume(drm_dev, false, false);
 698         drm_kms_helper_poll_enable(drm_dev);
 699         vga_switcheroo_set_dynamic_switch(pdev, VGA_SWITCHEROO_ON);
 700         drm_dev->switch_power_state = DRM_SWITCH_POWER_ON;
 701         return 0;
 702 }
 703
 704 static int amdgpu_pmops_runtime_idle(struct device *dev)
 705 {
 706         struct pci_dev *pdev = to_pci_dev(dev);
 707         struct drm_device *drm_dev = pci_get_drvdata(pdev);
 708         struct drm_crtc *crtc;
 709
 710         if (!amdgpu_device_is_px(drm_dev)) {
 711                 pm_runtime_forbid(dev);
 712                 return -EBUSY;
 713         }
 714
 715         list_for_each_entry(crtc, &drm_dev->mode_config.crtc_list, head) {
 716                 if (crtc->enabled) {
 717                         DRM_DEBUG_DRIVER("failing to power off - crtc active\n");
 718                         return -EBUSY;
 719                 }
 720         }
 721
 722         pm_runtime_mark_last_busy(dev);
 723         pm_runtime_autosuspend(dev);
 724         /* we don't want the main rpm_idle to call suspend - we want to autosuspend */
 725         return 1;
 726 }
 727
 728 long amdgpu_drm_ioctl(struct file *filp,
 729                       unsigned int cmd, unsigned long arg)
 730 {
 731         struct drm_file *file_priv = filp->private_data;
 732         struct drm_device *dev;
 733         long ret;
 734         dev = file_priv->minor->dev;
 735         ret = pm_runtime_get_sync(dev->dev);
 736         if (ret < 0)
 737                 return ret;
 738
 739         ret = drm_ioctl(filp, cmd, arg);
 740
 741         pm_runtime_mark_last_busy(dev->dev);
 742         pm_runtime_put_autosuspend(dev->dev);
 743         return ret;
 744 }
 745
 746 static const struct dev_pm_ops amdgpu_pm_ops = {
 747         .suspend = amdgpu_pmops_suspend,
 748         .resume = amdgpu_pmops_resume,
 749         .freeze = amdgpu_pmops_freeze,
 750         .thaw = amdgpu_pmops_thaw,
 751         .poweroff = amdgpu_pmops_poweroff,
 752         .restore = amdgpu_pmops_restore,
 753         .runtime_suspend = amdgpu_pmops_runtime_suspend,
 754         .runtime_resume = amdgpu_pmops_runtime_resume,
 755         .runtime_idle = amdgpu_pmops_runtime_idle,
 756 };
 757
 758 static const struct file_operations amdgpu_driver_kms_fops = {
 759         .owner = THIS_MODULE,
 760         .open = drm_open,
 761         .release = drm_release,
 762         .unlocked_ioctl = amdgpu_drm_ioctl,
 763         .mmap = amdgpu_mmap,
 764         .poll = drm_poll,
 765         .read = drm_read,
 766 #ifdef CONFIG_COMPAT
 767         .compat_ioctl = amdgpu_kms_compat_ioctl,
 768 #endif
 769 };
 770
 771 static bool
 772 amdgpu_get_crtc_scanout_position(struct drm_device *dev, unsigned int pipe,
 773                                  bool in_vblank_irq, int *vpos, int *hpos,
 774                                  ktime_t *stime, ktime_t *etime,
 775                                  const struct drm_display_mode *mode)
 776 {
 777         return amdgpu_get_crtc_scanoutpos(dev, pipe, 0, vpos, hpos,
 778                                           stime, etime, mode);
 779 }
 780
 781 static struct drm_driver kms_driver = {
 782         .driver_features =
 783             DRIVER_USE_AGP |
 784             DRIVER_HAVE_IRQ | DRIVER_IRQ_SHARED | DRIVER_GEM |
 785             DRIVER_PRIME | DRIVER_RENDER | DRIVER_MODESET,
 786         .load = amdgpu_driver_load_kms,
 787         .open = amdgpu_driver_open_kms,
 788         .postclose = amdgpu_driver_postclose_kms,
 789         .lastclose = amdgpu_driver_lastclose_kms,
 790         .set_busid = drm_pci_set_busid,
 791         .unload = amdgpu_driver_unload_kms,
 792         .get_vblank_counter = amdgpu_get_vblank_counter_kms,
 793         .enable_vblank = amdgpu_enable_vblank_kms,
 794         .disable_vblank = amdgpu_disable_vblank_kms,
 795         .get_vblank_timestamp = drm_calc_vbltimestamp_from_scanoutpos,
 796         .get_scanout_position = amdgpu_get_crtc_scanout_position,
 797 #if defined(CONFIG_DEBUG_FS)
 798         .debugfs_init = amdgpu_debugfs_init,
 799 #endif
 800         .irq_preinstall = amdgpu_irq_preinstall,
 801         .irq_postinstall = amdgpu_irq_postinstall,
 802         .irq_uninstall = amdgpu_irq_uninstall,
 803         .irq_handler = amdgpu_irq_handler,
 804         .ioctls = amdgpu_ioctls_kms,
 805         .gem_free_object_unlocked = amdgpu_gem_object_free,
 806         .gem_open_object = amdgpu_gem_object_open,
 807         .gem_close_object = amdgpu_gem_object_close,
 808         .dumb_create = amdgpu_mode_dumb_create,
 809         .dumb_map_offset = amdgpu_mode_dumb_mmap,
 810         .dumb_destroy = drm_gem_dumb_destroy,
 811         .fops = &amdgpu_driver_kms_fops,
 812
 813         .prime_handle_to_fd = drm_gem_prime_handle_to_fd,
 814         .prime_fd_to_handle = drm_gem_prime_fd_to_handle,
 815         .gem_prime_export = amdgpu_gem_prime_export,
 816         .gem_prime_import = drm_gem_prime_import,
 817         .gem_prime_pin = amdgpu_gem_prime_pin,
 818         .gem_prime_unpin = amdgpu_gem_prime_unpin,
 819         .gem_prime_res_obj = amdgpu_gem_prime_res_obj,
 820         .gem_prime_get_sg_table = amdgpu_gem_prime_get_sg_table,
 821         .gem_prime_import_sg_table = amdgpu_gem_prime_import_sg_table,
 822         .gem_prime_vmap = amdgpu_gem_prime_vmap,
 823         .gem_prime_vunmap = amdgpu_gem_prime_vunmap,
 824
 825         .name = DRIVER_NAME,
 826         .desc = DRIVER_DESC,
 827         .date = DRIVER_DATE,
 828         .major = KMS_DRIVER_MAJOR,
 829         .minor = KMS_DRIVER_MINOR,
 830         .patchlevel = KMS_DRIVER_PATCHLEVEL,
 831 };
 832
 833 static struct drm_driver *driver;
 834 static struct pci_driver *pdriver;
 835
 836 static struct pci_driver amdgpu_kms_pci_driver = {
 837         .name = DRIVER_NAME,
 838         .id_table = pciidlist,
 839         .probe = amdgpu_pci_probe,
 840         .remove = amdgpu_pci_remove,
 841         .shutdown = amdgpu_pci_shutdown,
 842         .driver.pm = &amdgpu_pm_ops,
 843 };
 844
 845
 846
 847 static int __init amdgpu_init(void)
 848 {
 849         int r;
 850
 851         r = amdgpu_sync_init();
 852         if (r)
 853                 goto error_sync;
 854
 855         r = amdgpu_fence_slab_init();
 856         if (r)
 857                 goto error_fence;
 858
 859         r = amd_sched_fence_slab_init();
 860         if (r)
 861                 goto error_sched;
 862
 863         if (vgacon_text_force()) {
 864                 DRM_ERROR("VGACON disables amdgpu kernel modesetting.\n");
 865                 return -EINVAL;
 866         }
 867         DRM_INFO("amdgpu kernel modesetting enabled.\n");
 868         driver = &kms_driver;
 869         pdriver = &amdgpu_kms_pci_driver;
 870         driver->num_ioctls = amdgpu_max_kms_ioctl;
 871         amdgpu_register_atpx_handler();
 872         /* let modprobe override vga console setting */
 873         return pci_register_driver(pdriver);
 874
 875 error_sched:
 876         amdgpu_fence_slab_fini();
 877
 878 error_fence:
 879         amdgpu_sync_fini();
 880
 881 error_sync:
 882         return r;
 883 }
 884
 885 static void __exit amdgpu_exit(void)
 886 {
 887         amdgpu_amdkfd_fini();
 888         pci_unregister_driver(pdriver);
 889         amdgpu_unregister_atpx_handler();
 890         amdgpu_sync_fini();
 891         amd_sched_fence_slab_fini();
 892         amdgpu_fence_slab_fini();
 893 }
 894
 895 module_init(amdgpu_init);
 896 module_exit(amdgpu_exit);
 897
 898 MODULE_AUTHOR(DRIVER_AUTHOR);
 899 MODULE_DESCRIPTION(DRIVER_DESC);
 900 MODULE_LICENSE("GPL and additional rights");