drivers/gpu/drm/nouveau/nouveau_channel.c

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  22  * DEALINGS IN THE SOFTWARE.
  23  */
  24
  25 #include "drmP.h"
  26 #include "drm.h"
  27 #include "nouveau_drv.h"
  28 #include "nouveau_drm.h"
  29 #include "nouveau_dma.h"
  30 #include "nouveau_ramht.h"
  31 #include "nouveau_fence.h"
  32 #include "nouveau_software.h"
  33
  34 static int
  35 nouveau_channel_pushbuf_init(struct nouveau_channel *chan)
  36 {
  37         u32 mem = nouveau_vram_pushbuf ? TTM_PL_FLAG_VRAM : TTM_PL_FLAG_TT;
  38         struct drm_device *dev = chan->dev;
  39         struct drm_nouveau_private *dev_priv = dev->dev_private;
  40         int ret;
  41
  42         /* allocate buffer object */
  43         ret = nouveau_bo_new(dev, 65536, 0, mem, 0, 0, NULL, &chan->pushbuf_bo);
  44         if (ret)
  45                 goto out;
  46
  47         ret = nouveau_bo_pin(chan->pushbuf_bo, mem);
  48         if (ret)
  49                 goto out;
  50
  51         ret = nouveau_bo_map(chan->pushbuf_bo);
  52         if (ret)
  53                 goto out;
  54
  55         /* create DMA object covering the entire memtype where the push
  56          * buffer resides, userspace can submit its own push buffers from
  57          * anywhere within the same memtype.
  58          */
  59         chan->pushbuf_base = chan->pushbuf_bo->bo.offset;
  60         if (dev_priv->card_type >= NV_50) {
  61                 ret = nouveau_bo_vma_add(chan->pushbuf_bo, chan->vm,
  62                                          &chan->pushbuf_vma);
  63                 if (ret)
  64                         goto out;
  65
  66                 if (dev_priv->card_type < NV_C0) {
  67                         ret = nouveau_gpuobj_dma_new(chan,
  68                                                      NV_CLASS_DMA_IN_MEMORY, 0,
  69                                                      (1ULL << 40),
  70                                                      NV_MEM_ACCESS_RO,
  71                                                      NV_MEM_TARGET_VM,
  72                                                      &chan->pushbuf);
  73                 }
  74                 chan->pushbuf_base = chan->pushbuf_vma.offset;
  75         } else
  76         if (chan->pushbuf_bo->bo.mem.mem_type == TTM_PL_TT) {
  77                 ret = nouveau_gpuobj_dma_new(chan, NV_CLASS_DMA_IN_MEMORY, 0,
  78                                              dev_priv->gart_info.aper_size,
  79                                              NV_MEM_ACCESS_RO,
  80                                              NV_MEM_TARGET_GART,
  81                                              &chan->pushbuf);
  82         } else
  83         if (dev_priv->card_type != NV_04) {
  84                 ret = nouveau_gpuobj_dma_new(chan, NV_CLASS_DMA_IN_MEMORY, 0,
  85                                              dev_priv->fb_available_size,
  86                                              NV_MEM_ACCESS_RO,
  87                                              NV_MEM_TARGET_VRAM,
  88                                              &chan->pushbuf);
  89         } else {
  90                 /* NV04 cmdbuf hack, from original ddx.. not sure of it's
  91                  * exact reason for existing :)  PCI access to cmdbuf in
  92                  * VRAM.
  93                  */
  94                 ret = nouveau_gpuobj_dma_new(chan, NV_CLASS_DMA_IN_MEMORY,
  95                                              pci_resource_start(dev->pdev, 1),
  96                                              dev_priv->fb_available_size,
  97                                              NV_MEM_ACCESS_RO,
  98                                              NV_MEM_TARGET_PCI,
  99                                              &chan->pushbuf);
 100         }
 101
 102 out:
 103         if (ret) {
 104                 NV_ERROR(dev, "error initialising pushbuf: %d\n", ret);
 105                 nouveau_bo_vma_del(chan->pushbuf_bo, &chan->pushbuf_vma);
 106                 nouveau_gpuobj_ref(NULL, &chan->pushbuf);
 107                 if (chan->pushbuf_bo) {
 108                         nouveau_bo_unmap(chan->pushbuf_bo);
 109                         nouveau_bo_ref(NULL, &chan->pushbuf_bo);
 110                 }
 111         }
 112
 113         return 0;
 114 }
 115
 116 /* allocates and initializes a fifo for user space consumption */
 117 int
 118 nouveau_channel_alloc(struct drm_device *dev, struct nouveau_channel **chan_ret,
 119                       struct drm_file *file_priv,
 120                       uint32_t vram_handle, uint32_t gart_handle)
 121 {
 122         struct nouveau_exec_engine *fence = nv_engine(dev, NVOBJ_ENGINE_FENCE);
 123         struct drm_nouveau_private *dev_priv = dev->dev_private;
 124         struct nouveau_fifo_engine *pfifo = &dev_priv->engine.fifo;
 125         struct nouveau_fpriv *fpriv = nouveau_fpriv(file_priv);
 126         struct nouveau_channel *chan;
 127         unsigned long flags;
 128         int ret, i;
 129
 130         /* allocate and lock channel structure */
 131         chan = kzalloc(sizeof(*chan), GFP_KERNEL);
 132         if (!chan)
 133                 return -ENOMEM;
 134         chan->dev = dev;
 135         chan->file_priv = file_priv;
 136         chan->vram_handle = vram_handle;
 137         chan->gart_handle = gart_handle;
 138
 139         kref_init(&chan->ref);
 140         atomic_set(&chan->users, 1);
 141         mutex_init(&chan->mutex);
 142         mutex_lock(&chan->mutex);
 143
 144         /* allocate hw channel id */
 145         spin_lock_irqsave(&dev_priv->channels.lock, flags);
 146         for (chan->id = 0; chan->id < pfifo->channels; chan->id++) {
 147                 if (!dev_priv->channels.ptr[chan->id]) {
 148                         nouveau_channel_ref(chan, &dev_priv->channels.ptr[chan->id]);
 149                         break;
 150                 }
 151         }
 152         spin_unlock_irqrestore(&dev_priv->channels.lock, flags);
 153
 154         if (chan->id == pfifo->channels) {
 155                 mutex_unlock(&chan->mutex);
 156                 kfree(chan);
 157                 return -ENODEV;
 158         }
 159
 160         NV_DEBUG(dev, "initialising channel %d\n", chan->id);
 161
 162         /* setup channel's memory and vm */
 163         ret = nouveau_gpuobj_channel_init(chan, vram_handle, gart_handle);
 164         if (ret) {
 165                 NV_ERROR(dev, "gpuobj %d\n", ret);
 166                 nouveau_channel_put(&chan);
 167                 return ret;
 168         }
 169
 170         /* Allocate space for per-channel fixed notifier memory */
 171         ret = nouveau_notifier_init_channel(chan);
 172         if (ret) {
 173                 NV_ERROR(dev, "ntfy %d\n", ret);
 174                 nouveau_channel_put(&chan);
 175                 return ret;
 176         }
 177
 178         /* Allocate DMA push buffer */
 179         ret = nouveau_channel_pushbuf_init(chan);
 180         if (ret) {
 181                 NV_ERROR(dev, "pushbuf %d\n", ret);
 182                 nouveau_channel_put(&chan);
 183                 return ret;
 184         }
 185
 186         nouveau_dma_init(chan);
 187         chan->user_put = 0x40;
 188         chan->user_get = 0x44;
 189         if (dev_priv->card_type >= NV_50)
 190                 chan->user_get_hi = 0x60;
 191
 192         /* disable the fifo caches */
 193         pfifo->reassign(dev, false);
 194
 195         /* Construct initial RAMFC for new channel */
 196         ret = pfifo->create_context(chan);
 197         if (ret) {
 198                 nouveau_channel_put(&chan);
 199                 return ret;
 200         }
 201
 202         pfifo->reassign(dev, true);
 203
 204         /* Insert NOPs for NOUVEAU_DMA_SKIPS */
 205         ret = RING_SPACE(chan, NOUVEAU_DMA_SKIPS);
 206         if (ret) {
 207                 nouveau_channel_put(&chan);
 208                 return ret;
 209         }
 210
 211         for (i = 0; i < NOUVEAU_DMA_SKIPS; i++)
 212                 OUT_RING  (chan, 0x00000000);
 213
 214         ret = nouveau_gpuobj_gr_new(chan, NvSw, nouveau_software_class(dev));
 215         if (ret) {
 216                 nouveau_channel_put(&chan);
 217                 return ret;
 218         }
 219
 220         if (dev_priv->card_type < NV_C0) {
 221                 ret = RING_SPACE(chan, 2);
 222                 if (ret) {
 223                         nouveau_channel_put(&chan);
 224                         return ret;
 225                 }
 226
 227                 BEGIN_NV04(chan, NvSubSw, NV01_SUBCHAN_OBJECT, 1);
 228                 OUT_RING  (chan, NvSw);
 229                 FIRE_RING (chan);
 230         }
 231
 232         FIRE_RING(chan);
 233
 234         ret = fence->context_new(chan, NVOBJ_ENGINE_FENCE);
 235         if (ret) {
 236                 nouveau_channel_put(&chan);
 237                 return ret;
 238         }
 239
 240         nouveau_debugfs_channel_init(chan);
 241
 242         NV_DEBUG(dev, "channel %d initialised\n", chan->id);
 243         if (fpriv) {
 244                 spin_lock(&fpriv->lock);
 245                 list_add(&chan->list, &fpriv->channels);
 246                 spin_unlock(&fpriv->lock);
 247         }
 248         *chan_ret = chan;
 249         return 0;
 250 }
 251
 252 struct nouveau_channel *
 253 nouveau_channel_get_unlocked(struct nouveau_channel *ref)
 254 {
 255         struct nouveau_channel *chan = NULL;
 256
 257         if (likely(ref && atomic_inc_not_zero(&ref->users)))
 258                 nouveau_channel_ref(ref, &chan);
 259
 260         return chan;
 261 }
 262
 263 struct nouveau_channel *
 264 nouveau_channel_get(struct drm_file *file_priv, int id)
 265 {
 266         struct nouveau_fpriv *fpriv = nouveau_fpriv(file_priv);
 267         struct nouveau_channel *chan;
 268
 269         spin_lock(&fpriv->lock);
 270         list_for_each_entry(chan, &fpriv->channels, list) {
 271                 if (chan->id == id) {
 272                         chan = nouveau_channel_get_unlocked(chan);
 273                         spin_unlock(&fpriv->lock);
 274                         mutex_lock(&chan->mutex);
 275                         return chan;
 276                 }
 277         }
 278         spin_unlock(&fpriv->lock);
 279
 280         return ERR_PTR(-EINVAL);
 281 }
 282
 283 void
 284 nouveau_channel_put_unlocked(struct nouveau_channel **pchan)
 285 {
 286         struct nouveau_channel *chan = *pchan;
 287         struct drm_device *dev = chan->dev;
 288         struct drm_nouveau_private *dev_priv = dev->dev_private;
 289         struct nouveau_fifo_engine *pfifo = &dev_priv->engine.fifo;
 290         unsigned long flags;
 291         int i;
 292
 293         /* decrement the refcount, and we're done if there's still refs */
 294         if (likely(!atomic_dec_and_test(&chan->users))) {
 295                 nouveau_channel_ref(NULL, pchan);
 296                 return;
 297         }
 298
 299         /* no one wants the channel anymore */
 300         NV_DEBUG(dev, "freeing channel %d\n", chan->id);
 301         nouveau_debugfs_channel_fini(chan);
 302
 303         /* give it chance to idle */
 304         nouveau_channel_idle(chan);
 305
 306         /* boot it off the hardware */
 307         pfifo->reassign(dev, false);
 308
 309         /* destroy the engine specific contexts */
 310         for (i = NVOBJ_ENGINE_NR - 1; i >= 0; i--) {
 311                 if (chan->engctx[i])
 312                         dev_priv->eng[i]->context_del(chan, i);
 313                 /*XXX: clean this up later, order is important */
 314                 if (i == NVOBJ_ENGINE_FENCE)
 315                         pfifo->destroy_context(chan);
 316         }
 317
 318         pfifo->reassign(dev, true);
 319
 320         /* aside from its resources, the channel should now be dead,
 321          * remove it from the channel list
 322          */
 323         spin_lock_irqsave(&dev_priv->channels.lock, flags);
 324         nouveau_channel_ref(NULL, &dev_priv->channels.ptr[chan->id]);
 325         spin_unlock_irqrestore(&dev_priv->channels.lock, flags);
 326
 327         /* destroy any resources the channel owned */
 328         nouveau_gpuobj_ref(NULL, &chan->pushbuf);
 329         if (chan->pushbuf_bo) {
 330                 nouveau_bo_vma_del(chan->pushbuf_bo, &chan->pushbuf_vma);
 331                 nouveau_bo_unmap(chan->pushbuf_bo);
 332                 nouveau_bo_unpin(chan->pushbuf_bo);
 333                 nouveau_bo_ref(NULL, &chan->pushbuf_bo);
 334         }
 335         nouveau_ramht_ref(NULL, &chan->ramht, chan);
 336         nouveau_notifier_takedown_channel(chan);
 337         nouveau_gpuobj_channel_takedown(chan);
 338
 339         nouveau_channel_ref(NULL, pchan);
 340 }
 341
 342 void
 343 nouveau_channel_put(struct nouveau_channel **pchan)
 344 {
 345         mutex_unlock(&(*pchan)->mutex);
 346         nouveau_channel_put_unlocked(pchan);
 347 }
 348
 349 static void
 350 nouveau_channel_del(struct kref *ref)
 351 {
 352         struct nouveau_channel *chan =
 353                 container_of(ref, struct nouveau_channel, ref);
 354
 355         kfree(chan);
 356 }
 357
 358 void
 359 nouveau_channel_ref(struct nouveau_channel *chan,
 360                     struct nouveau_channel **pchan)
 361 {
 362         if (chan)
 363                 kref_get(&chan->ref);
 364
 365         if (*pchan)
 366                 kref_put(&(*pchan)->ref, nouveau_channel_del);
 367
 368         *pchan = chan;
 369 }
 370
 371 void
 372 nouveau_channel_idle(struct nouveau_channel *chan)
 373 {
 374         struct drm_device *dev = chan->dev;
 375         struct nouveau_fence *fence = NULL;
 376         int ret;
 377
 378         ret = nouveau_fence_new(chan, &fence);
 379         if (!ret) {
 380                 ret = nouveau_fence_wait(fence, false, false);
 381                 nouveau_fence_unref(&fence);
 382         }
 383
 384         if (ret)
 385                 NV_ERROR(dev, "Failed to idle channel %d.\n", chan->id);
 386 }
 387
 388 /* cleans up all the fifos from file_priv */
 389 void
 390 nouveau_channel_cleanup(struct drm_device *dev, struct drm_file *file_priv)
 391 {
 392         struct drm_nouveau_private *dev_priv = dev->dev_private;
 393         struct nouveau_engine *engine = &dev_priv->engine;
 394         struct nouveau_channel *chan;
 395         int i;
 396
 397         NV_DEBUG(dev, "clearing FIFO enables from file_priv\n");
 398         for (i = 0; i < engine->fifo.channels; i++) {
 399                 chan = nouveau_channel_get(file_priv, i);
 400                 if (IS_ERR(chan))
 401                         continue;
 402
 403                 list_del(&chan->list);
 404                 atomic_dec(&chan->users);
 405                 nouveau_channel_put(&chan);
 406         }
 407 }
 408
 409
 410 /***********************************
 411  * ioctls wrapping the functions
 412  ***********************************/
 413
 414 static int
 415 nouveau_ioctl_fifo_alloc(struct drm_device *dev, void *data,
 416                          struct drm_file *file_priv)
 417 {
 418         struct drm_nouveau_private *dev_priv = dev->dev_private;
 419         struct drm_nouveau_channel_alloc *init = data;
 420         struct nouveau_channel *chan;
 421         int ret;
 422
 423         if (!dev_priv->eng[NVOBJ_ENGINE_GR])
 424                 return -ENODEV;
 425
 426         if (init->fb_ctxdma_handle == ~0 || init->tt_ctxdma_handle == ~0)
 427                 return -EINVAL;
 428
 429         ret = nouveau_channel_alloc(dev, &chan, file_priv,
 430                                     init->fb_ctxdma_handle,
 431                                     init->tt_ctxdma_handle);
 432         if (ret)
 433                 return ret;
 434         init->channel  = chan->id;
 435
 436         if (nouveau_vram_pushbuf == 0) {
 437                 if (chan->dma.ib_max)
 438                         init->pushbuf_domains = NOUVEAU_GEM_DOMAIN_VRAM |
 439                                                 NOUVEAU_GEM_DOMAIN_GART;
 440                 else if (chan->pushbuf_bo->bo.mem.mem_type == TTM_PL_VRAM)
 441                         init->pushbuf_domains = NOUVEAU_GEM_DOMAIN_VRAM;
 442                 else
 443                         init->pushbuf_domains = NOUVEAU_GEM_DOMAIN_GART;
 444         } else {
 445                 init->pushbuf_domains = NOUVEAU_GEM_DOMAIN_VRAM;
 446         }
 447
 448         if (dev_priv->card_type < NV_C0) {
 449                 init->subchan[0].handle = 0x00000000;
 450                 init->subchan[0].grclass = 0x0000;
 451                 init->subchan[1].handle = NvSw;
 452                 init->subchan[1].grclass = NV_SW;
 453                 init->nr_subchan = 2;
 454         }
 455
 456         /* Named memory object area */
 457         ret = drm_gem_handle_create(file_priv, chan->notifier_bo->gem,
 458                                     &init->notifier_handle);
 459
 460         if (ret == 0)
 461                 atomic_inc(&chan->users); /* userspace reference */
 462         nouveau_channel_put(&chan);
 463         return ret;
 464 }
 465
 466 static int
 467 nouveau_ioctl_fifo_free(struct drm_device *dev, void *data,
 468                         struct drm_file *file_priv)
 469 {
 470         struct drm_nouveau_channel_free *req = data;
 471         struct nouveau_channel *chan;
 472
 473         chan = nouveau_channel_get(file_priv, req->channel);
 474         if (IS_ERR(chan))
 475                 return PTR_ERR(chan);
 476
 477         list_del(&chan->list);
 478         atomic_dec(&chan->users);
 479         nouveau_channel_put(&chan);
 480         return 0;
 481 }
 482
 483 /***********************************
 484  * finally, the ioctl table
 485  ***********************************/
 486
 487 struct drm_ioctl_desc nouveau_ioctls[] = {
 488         DRM_IOCTL_DEF_DRV(NOUVEAU_GETPARAM, nouveau_ioctl_getparam, DRM_UNLOCKED|DRM_AUTH),
 489         DRM_IOCTL_DEF_DRV(NOUVEAU_SETPARAM, nouveau_ioctl_setparam, DRM_UNLOCKED|DRM_AUTH|DRM_MASTER|DRM_ROOT_ONLY),
 490         DRM_IOCTL_DEF_DRV(NOUVEAU_CHANNEL_ALLOC, nouveau_ioctl_fifo_alloc, DRM_UNLOCKED|DRM_AUTH),
 491         DRM_IOCTL_DEF_DRV(NOUVEAU_CHANNEL_FREE, nouveau_ioctl_fifo_free, DRM_UNLOCKED|DRM_AUTH),
 492         DRM_IOCTL_DEF_DRV(NOUVEAU_GROBJ_ALLOC, nouveau_ioctl_grobj_alloc, DRM_UNLOCKED|DRM_AUTH),
 493         DRM_IOCTL_DEF_DRV(NOUVEAU_NOTIFIEROBJ_ALLOC, nouveau_ioctl_notifier_alloc, DRM_UNLOCKED|DRM_AUTH),
 494         DRM_IOCTL_DEF_DRV(NOUVEAU_GPUOBJ_FREE, nouveau_ioctl_gpuobj_free, DRM_UNLOCKED|DRM_AUTH),
 495         DRM_IOCTL_DEF_DRV(NOUVEAU_GEM_NEW, nouveau_gem_ioctl_new, DRM_UNLOCKED|DRM_AUTH),
 496         DRM_IOCTL_DEF_DRV(NOUVEAU_GEM_PUSHBUF, nouveau_gem_ioctl_pushbuf, DRM_UNLOCKED|DRM_AUTH),
 497         DRM_IOCTL_DEF_DRV(NOUVEAU_GEM_CPU_PREP, nouveau_gem_ioctl_cpu_prep, DRM_UNLOCKED|DRM_AUTH),
 498         DRM_IOCTL_DEF_DRV(NOUVEAU_GEM_CPU_FINI, nouveau_gem_ioctl_cpu_fini, DRM_UNLOCKED|DRM_AUTH),
 499         DRM_IOCTL_DEF_DRV(NOUVEAU_GEM_INFO, nouveau_gem_ioctl_info, DRM_UNLOCKED|DRM_AUTH),
 500 };
 501
 502 int nouveau_max_ioctl = DRM_ARRAY_SIZE(nouveau_ioctls);