drivers/gpu/drm/nouveau/nv04_pm.c

   1 /*
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   3  *
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  21  *
  22  * Authors: Ben Skeggs
  23  */
  24
  25 #include "drmP.h"
  26 #include "nouveau_drv.h"
  27 #include "nouveau_hw.h"
  28 #include "nouveau_pm.h"
  29
  30 struct nv04_pm_state {
  31         struct pll_lims pll;
  32         struct nouveau_pll_vals calc;
  33 };
  34
  35 int
  36 nv04_pm_clock_get(struct drm_device *dev, u32 id)
  37 {
  38         return nouveau_hw_get_clock(dev, id);
  39 }
  40
  41 void *
  42 nv04_pm_clock_pre(struct drm_device *dev, u32 id, int khz)
  43 {
  44         struct nv04_pm_state *state;
  45         int ret;
  46
  47         state = kzalloc(sizeof(*state), GFP_KERNEL);
  48         if (!state)
  49                 return ERR_PTR(-ENOMEM);
  50
  51         ret = get_pll_limits(dev, id, &state->pll);
  52         if (ret) {
  53                 kfree(state);
  54                 return (ret == -ENOENT) ? NULL : ERR_PTR(ret);
  55         }
  56
  57         ret = nouveau_calc_pll_mnp(dev, &state->pll, khz, &state->calc);
  58         if (!ret) {
  59                 kfree(state);
  60                 return ERR_PTR(-EINVAL);
  61         }
  62
  63         return state;
  64 }
  65
  66 void
  67 nv04_pm_clock_set(struct drm_device *dev, void *pre_state)
  68 {
  69         struct drm_nouveau_private *dev_priv = dev->dev_private;
  70         struct nv04_pm_state *state = pre_state;
  71         u32 reg = state->pll.reg;
  72
  73         /* thank the insane nouveau_hw_setpll() interface for this */
  74         if (dev_priv->card_type >= NV_40)
  75                 reg += 4;
  76
  77         nouveau_hw_setpll(dev, reg, &state->calc);
  78         kfree(state);
  79 }
  80