drivers/net/ethernet/amazon/ena/ena_com.h

   1 /*
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  30  * SOFTWARE.
  31  */
  32
  33 #ifndef ENA_COM
  34 #define ENA_COM
  35
  36 #include <linux/compiler.h>
  37 #include <linux/delay.h>
  38 #include <linux/dma-mapping.h>
  39 #include <linux/gfp.h>
  40 #include <linux/sched.h>
  41 #include <linux/sizes.h>
  42 #include <linux/spinlock.h>
  43 #include <linux/types.h>
  44 #include <linux/wait.h>
  45
  46 #include "ena_common_defs.h"
  47 #include "ena_admin_defs.h"
  48 #include "ena_eth_io_defs.h"
  49 #include "ena_regs_defs.h"
  50
  51 #undef pr_fmt
  52 #define pr_fmt(fmt) KBUILD_MODNAME ": " fmt
  53
  54 #define ENA_MAX_NUM_IO_QUEUES           128U
  55 /* We need to queues for each IO (on for Tx and one for Rx) */
  56 #define ENA_TOTAL_NUM_QUEUES            (2 * (ENA_MAX_NUM_IO_QUEUES))
  57
  58 #define ENA_MAX_HANDLERS 256
  59
  60 #define ENA_MAX_PHYS_ADDR_SIZE_BITS 48
  61
  62 /* Unit in usec */
  63 #define ENA_REG_READ_TIMEOUT 200000
  64
  65 #define ADMIN_SQ_SIZE(depth)    ((depth) * sizeof(struct ena_admin_aq_entry))
  66 #define ADMIN_CQ_SIZE(depth)    ((depth) * sizeof(struct ena_admin_acq_entry))
  67 #define ADMIN_AENQ_SIZE(depth)  ((depth) * sizeof(struct ena_admin_aenq_entry))
  68
  69 /*****************************************************************************/
  70 /*****************************************************************************/
  71 /* ENA adaptive interrupt moderation settings */
  72
  73 #define ENA_INTR_LOWEST_USECS           (0)
  74 #define ENA_INTR_LOWEST_PKTS            (3)
  75 #define ENA_INTR_LOWEST_BYTES           (2 * 1524)
  76
  77 #define ENA_INTR_LOW_USECS              (32)
  78 #define ENA_INTR_LOW_PKTS               (12)
  79 #define ENA_INTR_LOW_BYTES              (16 * 1024)
  80
  81 #define ENA_INTR_MID_USECS              (80)
  82 #define ENA_INTR_MID_PKTS               (48)
  83 #define ENA_INTR_MID_BYTES              (64 * 1024)
  84
  85 #define ENA_INTR_HIGH_USECS             (128)
  86 #define ENA_INTR_HIGH_PKTS              (96)
  87 #define ENA_INTR_HIGH_BYTES             (128 * 1024)
  88
  89 #define ENA_INTR_HIGHEST_USECS          (192)
  90 #define ENA_INTR_HIGHEST_PKTS           (128)
  91 #define ENA_INTR_HIGHEST_BYTES          (192 * 1024)
  92
  93 #define ENA_INTR_INITIAL_TX_INTERVAL_USECS              196
  94 #define ENA_INTR_INITIAL_RX_INTERVAL_USECS              4
  95 #define ENA_INTR_DELAY_OLD_VALUE_WEIGHT                 6
  96 #define ENA_INTR_DELAY_NEW_VALUE_WEIGHT                 4
  97 #define ENA_INTR_MODER_LEVEL_STRIDE                     2
  98 #define ENA_INTR_BYTE_COUNT_NOT_SUPPORTED               0xFFFFFF
  99
 100 enum ena_intr_moder_level {
 101         ENA_INTR_MODER_LOWEST = 0,
 102         ENA_INTR_MODER_LOW,
 103         ENA_INTR_MODER_MID,
 104         ENA_INTR_MODER_HIGH,
 105         ENA_INTR_MODER_HIGHEST,
 106         ENA_INTR_MAX_NUM_OF_LEVELS,
 107 };
 108
 109 struct ena_intr_moder_entry {
 110         unsigned int intr_moder_interval;
 111         unsigned int pkts_per_interval;
 112         unsigned int bytes_per_interval;
 113 };
 114
 115 enum queue_direction {
 116         ENA_COM_IO_QUEUE_DIRECTION_TX,
 117         ENA_COM_IO_QUEUE_DIRECTION_RX
 118 };
 119
 120 struct ena_com_buf {
 121         dma_addr_t paddr; /**< Buffer physical address */
 122         u16 len; /**< Buffer length in bytes */
 123 };
 124
 125 struct ena_com_rx_buf_info {
 126         u16 len;
 127         u16 req_id;
 128 };
 129
 130 struct ena_com_io_desc_addr {
 131         u8 __iomem *pbuf_dev_addr; /* LLQ address */
 132         u8 *virt_addr;
 133         dma_addr_t phys_addr;
 134 };
 135
 136 struct ena_com_tx_meta {
 137         u16 mss;
 138         u16 l3_hdr_len;
 139         u16 l3_hdr_offset;
 140         u16 l4_hdr_len; /* In words */
 141 };
 142
 143 struct ena_com_io_cq {
 144         struct ena_com_io_desc_addr cdesc_addr;
 145
 146         /* Interrupt unmask register */
 147         u32 __iomem *unmask_reg;
 148
 149         /* The completion queue head doorbell register */
 150         u32 __iomem *cq_head_db_reg;
 151
 152         /* numa configuration register (for TPH) */
 153         u32 __iomem *numa_node_cfg_reg;
 154
 155         /* The value to write to the above register to unmask
 156          * the interrupt of this queue
 157          */
 158         u32 msix_vector;
 159
 160         enum queue_direction direction;
 161
 162         /* holds the number of cdesc of the current packet */
 163         u16 cur_rx_pkt_cdesc_count;
 164         /* save the firt cdesc idx of the current packet */
 165         u16 cur_rx_pkt_cdesc_start_idx;
 166
 167         u16 q_depth;
 168         /* Caller qid */
 169         u16 qid;
 170
 171         /* Device queue index */
 172         u16 idx;
 173         u16 head;
 174         u16 last_head_update;
 175         u8 phase;
 176         u8 cdesc_entry_size_in_bytes;
 177
 178 } ____cacheline_aligned;
 179
 180 struct ena_com_io_sq {
 181         struct ena_com_io_desc_addr desc_addr;
 182
 183         u32 __iomem *db_addr;
 184         u8 __iomem *header_addr;
 185
 186         enum queue_direction direction;
 187         enum ena_admin_placement_policy_type mem_queue_type;
 188
 189         u32 msix_vector;
 190         struct ena_com_tx_meta cached_tx_meta;
 191
 192         u16 q_depth;
 193         u16 qid;
 194
 195         u16 idx;
 196         u16 tail;
 197         u16 next_to_comp;
 198         u32 tx_max_header_size;
 199         u8 phase;
 200         u8 desc_entry_size;
 201         u8 dma_addr_bits;
 202 } ____cacheline_aligned;
 203
 204 struct ena_com_admin_cq {
 205         struct ena_admin_acq_entry *entries;
 206         dma_addr_t dma_addr;
 207
 208         u16 head;
 209         u8 phase;
 210 };
 211
 212 struct ena_com_admin_sq {
 213         struct ena_admin_aq_entry *entries;
 214         dma_addr_t dma_addr;
 215
 216         u32 __iomem *db_addr;
 217
 218         u16 head;
 219         u16 tail;
 220         u8 phase;
 221
 222 };
 223
 224 struct ena_com_stats_admin {
 225         u32 aborted_cmd;
 226         u32 submitted_cmd;
 227         u32 completed_cmd;
 228         u32 out_of_space;
 229         u32 no_completion;
 230 };
 231
 232 struct ena_com_admin_queue {
 233         void *q_dmadev;
 234         spinlock_t q_lock; /* spinlock for the admin queue */
 235         struct ena_comp_ctx *comp_ctx;
 236         u16 q_depth;
 237         struct ena_com_admin_cq cq;
 238         struct ena_com_admin_sq sq;
 239
 240         /* Indicate if the admin queue should poll for completion */
 241         bool polling;
 242
 243         u16 curr_cmd_id;
 244
 245         /* Indicate that the ena was initialized and can
 246          * process new admin commands
 247          */
 248         bool running_state;
 249
 250         /* Count the number of outstanding admin commands */
 251         atomic_t outstanding_cmds;
 252
 253         struct ena_com_stats_admin stats;
 254 };
 255
 256 struct ena_aenq_handlers;
 257
 258 struct ena_com_aenq {
 259         u16 head;
 260         u8 phase;
 261         struct ena_admin_aenq_entry *entries;
 262         dma_addr_t dma_addr;
 263         u16 q_depth;
 264         struct ena_aenq_handlers *aenq_handlers;
 265 };
 266
 267 struct ena_com_mmio_read {
 268         struct ena_admin_ena_mmio_req_read_less_resp *read_resp;
 269         dma_addr_t read_resp_dma_addr;
 270         u16 seq_num;
 271         bool readless_supported;
 272         /* spin lock to ensure a single outstanding read */
 273         spinlock_t lock;
 274 };
 275
 276 struct ena_rss {
 277         /* Indirect table */
 278         u16 *host_rss_ind_tbl;
 279         struct ena_admin_rss_ind_table_entry *rss_ind_tbl;
 280         dma_addr_t rss_ind_tbl_dma_addr;
 281         u16 tbl_log_size;
 282
 283         /* Hash key */
 284         enum ena_admin_hash_functions hash_func;
 285         struct ena_admin_feature_rss_flow_hash_control *hash_key;
 286         dma_addr_t hash_key_dma_addr;
 287         u32 hash_init_val;
 288
 289         /* Flow Control */
 290         struct ena_admin_feature_rss_hash_control *hash_ctrl;
 291         dma_addr_t hash_ctrl_dma_addr;
 292
 293 };
 294
 295 struct ena_host_attribute {
 296         /* Debug area */
 297         u8 *debug_area_virt_addr;
 298         dma_addr_t debug_area_dma_addr;
 299         u32 debug_area_size;
 300
 301         /* Host information */
 302         struct ena_admin_host_info *host_info;
 303         dma_addr_t host_info_dma_addr;
 304 };
 305
 306 /* Each ena_dev is a PCI function. */
 307 struct ena_com_dev {
 308         struct ena_com_admin_queue admin_queue;
 309         struct ena_com_aenq aenq;
 310         struct ena_com_io_cq io_cq_queues[ENA_TOTAL_NUM_QUEUES];
 311         struct ena_com_io_sq io_sq_queues[ENA_TOTAL_NUM_QUEUES];
 312         u8 __iomem *reg_bar;
 313         void __iomem *mem_bar;
 314         void *dmadev;
 315
 316         enum ena_admin_placement_policy_type tx_mem_queue_type;
 317         u32 tx_max_header_size;
 318         u16 stats_func; /* Selected function for extended statistic dump */
 319         u16 stats_queue; /* Selected queue for extended statistic dump */
 320
 321         struct ena_com_mmio_read mmio_read;
 322
 323         struct ena_rss rss;
 324         u32 supported_features;
 325         u32 dma_addr_bits;
 326
 327         struct ena_host_attribute host_attr;
 328         bool adaptive_coalescing;
 329         u16 intr_delay_resolution;
 330         u32 intr_moder_tx_interval;
 331         struct ena_intr_moder_entry *intr_moder_tbl;
 332 };
 333
 334 struct ena_com_dev_get_features_ctx {
 335         struct ena_admin_queue_feature_desc max_queues;
 336         struct ena_admin_device_attr_feature_desc dev_attr;
 337         struct ena_admin_feature_aenq_desc aenq;
 338         struct ena_admin_feature_offload_desc offload;
 339 };
 340
 341 struct ena_com_create_io_ctx {
 342         enum ena_admin_placement_policy_type mem_queue_type;
 343         enum queue_direction direction;
 344         int numa_node;
 345         u32 msix_vector;
 346         u16 queue_size;
 347         u16 qid;
 348 };
 349
 350 typedef void (*ena_aenq_handler)(void *data,
 351         struct ena_admin_aenq_entry *aenq_e);
 352
 353 /* Holds aenq handlers. Indexed by AENQ event group */
 354 struct ena_aenq_handlers {
 355         ena_aenq_handler handlers[ENA_MAX_HANDLERS];
 356         ena_aenq_handler unimplemented_handler;
 357 };
 358
 359 /*****************************************************************************/
 360 /*****************************************************************************/
 361
 362 /* ena_com_mmio_reg_read_request_init - Init the mmio reg read mechanism
 363  * @ena_dev: ENA communication layer struct
 364  *
 365  * Initialize the register read mechanism.
 366  *
 367  * @note: This method must be the first stage in the initialization sequence.
 368  *
 369  * @return - 0 on success, negative value on failure.
 370  */
 371 int ena_com_mmio_reg_read_request_init(struct ena_com_dev *ena_dev);
 372
 373 /* ena_com_set_mmio_read_mode - Enable/disable the mmio reg read mechanism
 374  * @ena_dev: ENA communication layer struct
 375  * @readless_supported: readless mode (enable/disable)
 376  */
 377 void ena_com_set_mmio_read_mode(struct ena_com_dev *ena_dev,
 378                                 bool readless_supported);
 379
 380 /* ena_com_mmio_reg_read_request_write_dev_addr - Write the mmio reg read return
 381  * value physical address.
 382  * @ena_dev: ENA communication layer struct
 383  */
 384 void ena_com_mmio_reg_read_request_write_dev_addr(struct ena_com_dev *ena_dev);
 385
 386 /* ena_com_mmio_reg_read_request_destroy - Destroy the mmio reg read mechanism
 387  * @ena_dev: ENA communication layer struct
 388  */
 389 void ena_com_mmio_reg_read_request_destroy(struct ena_com_dev *ena_dev);
 390
 391 /* ena_com_admin_init - Init the admin and the async queues
 392  * @ena_dev: ENA communication layer struct
 393  * @aenq_handlers: Those handlers to be called upon event.
 394  * @init_spinlock: Indicate if this method should init the admin spinlock or
 395  * the spinlock was init before (for example, in a case of FLR).
 396  *
 397  * Initialize the admin submission and completion queues.
 398  * Initialize the asynchronous events notification queues.
 399  *
 400  * @return - 0 on success, negative value on failure.
 401  */
 402 int ena_com_admin_init(struct ena_com_dev *ena_dev,
 403                        struct ena_aenq_handlers *aenq_handlers,
 404                        bool init_spinlock);
 405
 406 /* ena_com_admin_destroy - Destroy the admin and the async events queues.
 407  * @ena_dev: ENA communication layer struct
 408  *
 409  * @note: Before calling this method, the caller must validate that the device
 410  * won't send any additional admin completions/aenq.
 411  * To achieve that, a FLR is recommended.
 412  */
 413 void ena_com_admin_destroy(struct ena_com_dev *ena_dev);
 414
 415 /* ena_com_dev_reset - Perform device FLR to the device.
 416  * @ena_dev: ENA communication layer struct
 417  *
 418  * @return - 0 on success, negative value on failure.
 419  */
 420 int ena_com_dev_reset(struct ena_com_dev *ena_dev);
 421
 422 /* ena_com_create_io_queue - Create io queue.
 423  * @ena_dev: ENA communication layer struct
 424  * @ctx - create context structure
 425  *
 426  * Create the submission and the completion queues.
 427  *
 428  * @return - 0 on success, negative value on failure.
 429  */
 430 int ena_com_create_io_queue(struct ena_com_dev *ena_dev,
 431                             struct ena_com_create_io_ctx *ctx);
 432
 433 /* ena_com_destroy_io_queue - Destroy IO queue with the queue id - qid.
 434  * @ena_dev: ENA communication layer struct
 435  * @qid - the caller virtual queue id.
 436  */
 437 void ena_com_destroy_io_queue(struct ena_com_dev *ena_dev, u16 qid);
 438
 439 /* ena_com_get_io_handlers - Return the io queue handlers
 440  * @ena_dev: ENA communication layer struct
 441  * @qid - the caller virtual queue id.
 442  * @io_sq - IO submission queue handler
 443  * @io_cq - IO completion queue handler.
 444  *
 445  * @return - 0 on success, negative value on failure.
 446  */
 447 int ena_com_get_io_handlers(struct ena_com_dev *ena_dev, u16 qid,
 448                             struct ena_com_io_sq **io_sq,
 449                             struct ena_com_io_cq **io_cq);
 450
 451 /* ena_com_admin_aenq_enable - ENAble asynchronous event notifications
 452  * @ena_dev: ENA communication layer struct
 453  *
 454  * After this method, aenq event can be received via AENQ.
 455  */
 456 void ena_com_admin_aenq_enable(struct ena_com_dev *ena_dev);
 457
 458 /* ena_com_set_admin_running_state - Set the state of the admin queue
 459  * @ena_dev: ENA communication layer struct
 460  *
 461  * Change the state of the admin queue (enable/disable)
 462  */
 463 void ena_com_set_admin_running_state(struct ena_com_dev *ena_dev, bool state);
 464
 465 /* ena_com_get_admin_running_state - Get the admin queue state
 466  * @ena_dev: ENA communication layer struct
 467  *
 468  * Retrieve the state of the admin queue (enable/disable)
 469  *
 470  * @return - current polling mode (enable/disable)
 471  */
 472 bool ena_com_get_admin_running_state(struct ena_com_dev *ena_dev);
 473
 474 /* ena_com_set_admin_polling_mode - Set the admin completion queue polling mode
 475  * @ena_dev: ENA communication layer struct
 476  * @polling: ENAble/Disable polling mode
 477  *
 478  * Set the admin completion mode.
 479  */
 480 void ena_com_set_admin_polling_mode(struct ena_com_dev *ena_dev, bool polling);
 481
 482 /* ena_com_set_admin_polling_mode - Get the admin completion queue polling mode
 483  * @ena_dev: ENA communication layer struct
 484  *
 485  * Get the admin completion mode.
 486  * If polling mode is on, ena_com_execute_admin_command will perform a
 487  * polling on the admin completion queue for the commands completion,
 488  * otherwise it will wait on wait event.
 489  *
 490  * @return state
 491  */
 492 bool ena_com_get_ena_admin_polling_mode(struct ena_com_dev *ena_dev);
 493
 494 /* ena_com_admin_q_comp_intr_handler - admin queue interrupt handler
 495  * @ena_dev: ENA communication layer struct
 496  *
 497  * This method go over the admin completion queue and wake up all the pending
 498  * threads that wait on the commands wait event.
 499  *
 500  * @note: Should be called after MSI-X interrupt.
 501  */
 502 void ena_com_admin_q_comp_intr_handler(struct ena_com_dev *ena_dev);
 503
 504 /* ena_com_aenq_intr_handler - AENQ interrupt handler
 505  * @ena_dev: ENA communication layer struct
 506  *
 507  * This method go over the async event notification queue and call the proper
 508  * aenq handler.
 509  */
 510 void ena_com_aenq_intr_handler(struct ena_com_dev *dev, void *data);
 511
 512 /* ena_com_abort_admin_commands - Abort all the outstanding admin commands.
 513  * @ena_dev: ENA communication layer struct
 514  *
 515  * This method aborts all the outstanding admin commands.
 516  * The caller should then call ena_com_wait_for_abort_completion to make sure
 517  * all the commands were completed.
 518  */
 519 void ena_com_abort_admin_commands(struct ena_com_dev *ena_dev);
 520
 521 /* ena_com_wait_for_abort_completion - Wait for admin commands abort.
 522  * @ena_dev: ENA communication layer struct
 523  *
 524  * This method wait until all the outstanding admin commands will be completed.
 525  */
 526 void ena_com_wait_for_abort_completion(struct ena_com_dev *ena_dev);
 527
 528 /* ena_com_validate_version - Validate the device parameters
 529  * @ena_dev: ENA communication layer struct
 530  *
 531  * This method validate the device parameters are the same as the saved
 532  * parameters in ena_dev.
 533  * This method is useful after device reset, to validate the device mac address
 534  * and the device offloads are the same as before the reset.
 535  *
 536  * @return - 0 on success negative value otherwise.
 537  */
 538 int ena_com_validate_version(struct ena_com_dev *ena_dev);
 539
 540 /* ena_com_get_link_params - Retrieve physical link parameters.
 541  * @ena_dev: ENA communication layer struct
 542  * @resp: Link parameters
 543  *
 544  * Retrieve the physical link parameters,
 545  * like speed, auto-negotiation and full duplex support.
 546  *
 547  * @return - 0 on Success negative value otherwise.
 548  */
 549 int ena_com_get_link_params(struct ena_com_dev *ena_dev,
 550                             struct ena_admin_get_feat_resp *resp);
 551
 552 /* ena_com_get_dma_width - Retrieve physical dma address width the device
 553  * supports.
 554  * @ena_dev: ENA communication layer struct
 555  *
 556  * Retrieve the maximum physical address bits the device can handle.
 557  *
 558  * @return: > 0 on Success and negative value otherwise.
 559  */
 560 int ena_com_get_dma_width(struct ena_com_dev *ena_dev);
 561
 562 /* ena_com_set_aenq_config - Set aenq groups configurations
 563  * @ena_dev: ENA communication layer struct
 564  * @groups flag: bit fields flags of enum ena_admin_aenq_group.
 565  *
 566  * Configure which aenq event group the driver would like to receive.
 567  *
 568  * @return: 0 on Success and negative value otherwise.
 569  */
 570 int ena_com_set_aenq_config(struct ena_com_dev *ena_dev, u32 groups_flag);
 571
 572 /* ena_com_get_dev_attr_feat - Get device features
 573  * @ena_dev: ENA communication layer struct
 574  * @get_feat_ctx: returned context that contain the get features.
 575  *
 576  * @return: 0 on Success and negative value otherwise.
 577  */
 578 int ena_com_get_dev_attr_feat(struct ena_com_dev *ena_dev,
 579                               struct ena_com_dev_get_features_ctx *get_feat_ctx);
 580
 581 /* ena_com_get_dev_basic_stats - Get device basic statistics
 582  * @ena_dev: ENA communication layer struct
 583  * @stats: stats return value
 584  *
 585  * @return: 0 on Success and negative value otherwise.
 586  */
 587 int ena_com_get_dev_basic_stats(struct ena_com_dev *ena_dev,
 588                                 struct ena_admin_basic_stats *stats);
 589
 590 /* ena_com_set_dev_mtu - Configure the device mtu.
 591  * @ena_dev: ENA communication layer struct
 592  * @mtu: mtu value
 593  *
 594  * @return: 0 on Success and negative value otherwise.
 595  */
 596 int ena_com_set_dev_mtu(struct ena_com_dev *ena_dev, int mtu);
 597
 598 /* ena_com_get_offload_settings - Retrieve the device offloads capabilities
 599  * @ena_dev: ENA communication layer struct
 600  * @offlad: offload return value
 601  *
 602  * @return: 0 on Success and negative value otherwise.
 603  */
 604 int ena_com_get_offload_settings(struct ena_com_dev *ena_dev,
 605                                  struct ena_admin_feature_offload_desc *offload);
 606
 607 /* ena_com_rss_init - Init RSS
 608  * @ena_dev: ENA communication layer struct
 609  * @log_size: indirection log size
 610  *
 611  * Allocate RSS/RFS resources.
 612  * The caller then can configure rss using ena_com_set_hash_function,
 613  * ena_com_set_hash_ctrl and ena_com_indirect_table_set.
 614  *
 615  * @return: 0 on Success and negative value otherwise.
 616  */
 617 int ena_com_rss_init(struct ena_com_dev *ena_dev, u16 log_size);
 618
 619 /* ena_com_rss_destroy - Destroy rss
 620  * @ena_dev: ENA communication layer struct
 621  *
 622  * Free all the RSS/RFS resources.
 623  */
 624 void ena_com_rss_destroy(struct ena_com_dev *ena_dev);
 625
 626 /* ena_com_fill_hash_function - Fill RSS hash function
 627  * @ena_dev: ENA communication layer struct
 628  * @func: The hash function (Toeplitz or crc)
 629  * @key: Hash key (for toeplitz hash)
 630  * @key_len: key length (max length 10 DW)
 631  * @init_val: initial value for the hash function
 632  *
 633  * Fill the ena_dev resources with the desire hash function, hash key, key_len
 634  * and key initial value (if needed by the hash function).
 635  * To flush the key into the device the caller should call
 636  * ena_com_set_hash_function.
 637  *
 638  * @return: 0 on Success and negative value otherwise.
 639  */
 640 int ena_com_fill_hash_function(struct ena_com_dev *ena_dev,
 641                                enum ena_admin_hash_functions func,
 642                                const u8 *key, u16 key_len, u32 init_val);
 643
 644 /* ena_com_set_hash_function - Flush the hash function and it dependencies to
 645  * the device.
 646  * @ena_dev: ENA communication layer struct
 647  *
 648  * Flush the hash function and it dependencies (key, key length and
 649  * initial value) if needed.
 650  *
 651  * @note: Prior to this method the caller should call ena_com_fill_hash_function
 652  *
 653  * @return: 0 on Success and negative value otherwise.
 654  */
 655 int ena_com_set_hash_function(struct ena_com_dev *ena_dev);
 656
 657 /* ena_com_get_hash_function - Retrieve the hash function and the hash key
 658  * from the device.
 659  * @ena_dev: ENA communication layer struct
 660  * @func: hash function
 661  * @key: hash key
 662  *
 663  * Retrieve the hash function and the hash key from the device.
 664  *
 665  * @note: If the caller called ena_com_fill_hash_function but didn't flash
 666  * it to the device, the new configuration will be lost.
 667  *
 668  * @return: 0 on Success and negative value otherwise.
 669  */
 670 int ena_com_get_hash_function(struct ena_com_dev *ena_dev,
 671                               enum ena_admin_hash_functions *func,
 672                               u8 *key);
 673
 674 /* ena_com_fill_hash_ctrl - Fill RSS hash control
 675  * @ena_dev: ENA communication layer struct.
 676  * @proto: The protocol to configure.
 677  * @hash_fields: bit mask of ena_admin_flow_hash_fields
 678  *
 679  * Fill the ena_dev resources with the desire hash control (the ethernet
 680  * fields that take part of the hash) for a specific protocol.
 681  * To flush the hash control to the device, the caller should call
 682  * ena_com_set_hash_ctrl.
 683  *
 684  * @return: 0 on Success and negative value otherwise.
 685  */
 686 int ena_com_fill_hash_ctrl(struct ena_com_dev *ena_dev,
 687                            enum ena_admin_flow_hash_proto proto,
 688                            u16 hash_fields);
 689
 690 /* ena_com_set_hash_ctrl - Flush the hash control resources to the device.
 691  * @ena_dev: ENA communication layer struct
 692  *
 693  * Flush the hash control (the ethernet fields that take part of the hash)
 694  *
 695  * @note: Prior to this method the caller should call ena_com_fill_hash_ctrl.
 696  *
 697  * @return: 0 on Success and negative value otherwise.
 698  */
 699 int ena_com_set_hash_ctrl(struct ena_com_dev *ena_dev);
 700
 701 /* ena_com_get_hash_ctrl - Retrieve the hash control from the device.
 702  * @ena_dev: ENA communication layer struct
 703  * @proto: The protocol to retrieve.
 704  * @fields: bit mask of ena_admin_flow_hash_fields.
 705  *
 706  * Retrieve the hash control from the device.
 707  *
 708  * @note, If the caller called ena_com_fill_hash_ctrl but didn't flash
 709  * it to the device, the new configuration will be lost.
 710  *
 711  * @return: 0 on Success and negative value otherwise.
 712  */
 713 int ena_com_get_hash_ctrl(struct ena_com_dev *ena_dev,
 714                           enum ena_admin_flow_hash_proto proto,
 715                           u16 *fields);
 716
 717 /* ena_com_set_default_hash_ctrl - Set the hash control to a default
 718  * configuration.
 719  * @ena_dev: ENA communication layer struct
 720  *
 721  * Fill the ena_dev resources with the default hash control configuration.
 722  * To flush the hash control to the device, the caller should call
 723  * ena_com_set_hash_ctrl.
 724  *
 725  * @return: 0 on Success and negative value otherwise.
 726  */
 727 int ena_com_set_default_hash_ctrl(struct ena_com_dev *ena_dev);
 728
 729 /* ena_com_indirect_table_fill_entry - Fill a single entry in the RSS
 730  * indirection table
 731  * @ena_dev: ENA communication layer struct.
 732  * @entry_idx - indirection table entry.
 733  * @entry_value - redirection value
 734  *
 735  * Fill a single entry of the RSS indirection table in the ena_dev resources.
 736  * To flush the indirection table to the device, the called should call
 737  * ena_com_indirect_table_set.
 738  *
 739  * @return: 0 on Success and negative value otherwise.
 740  */
 741 int ena_com_indirect_table_fill_entry(struct ena_com_dev *ena_dev,
 742                                       u16 entry_idx, u16 entry_value);
 743
 744 /* ena_com_indirect_table_set - Flush the indirection table to the device.
 745  * @ena_dev: ENA communication layer struct
 746  *
 747  * Flush the indirection hash control to the device.
 748  * Prior to this method the caller should call ena_com_indirect_table_fill_entry
 749  *
 750  * @return: 0 on Success and negative value otherwise.
 751  */
 752 int ena_com_indirect_table_set(struct ena_com_dev *ena_dev);
 753
 754 /* ena_com_indirect_table_get - Retrieve the indirection table from the device.
 755  * @ena_dev: ENA communication layer struct
 756  * @ind_tbl: indirection table
 757  *
 758  * Retrieve the RSS indirection table from the device.
 759  *
 760  * @note: If the caller called ena_com_indirect_table_fill_entry but didn't flash
 761  * it to the device, the new configuration will be lost.
 762  *
 763  * @return: 0 on Success and negative value otherwise.
 764  */
 765 int ena_com_indirect_table_get(struct ena_com_dev *ena_dev, u32 *ind_tbl);
 766
 767 /* ena_com_allocate_host_info - Allocate host info resources.
 768  * @ena_dev: ENA communication layer struct
 769  *
 770  * @return: 0 on Success and negative value otherwise.
 771  */
 772 int ena_com_allocate_host_info(struct ena_com_dev *ena_dev);
 773
 774 /* ena_com_allocate_debug_area - Allocate debug area.
 775  * @ena_dev: ENA communication layer struct
 776  * @debug_area_size - debug area size.
 777  *
 778  * @return: 0 on Success and negative value otherwise.
 779  */
 780 int ena_com_allocate_debug_area(struct ena_com_dev *ena_dev,
 781                                 u32 debug_area_size);
 782
 783 /* ena_com_delete_debug_area - Free the debug area resources.
 784  * @ena_dev: ENA communication layer struct
 785  *
 786  * Free the allocate debug area.
 787  */
 788 void ena_com_delete_debug_area(struct ena_com_dev *ena_dev);
 789
 790 /* ena_com_delete_host_info - Free the host info resources.
 791  * @ena_dev: ENA communication layer struct
 792  *
 793  * Free the allocate host info.
 794  */
 795 void ena_com_delete_host_info(struct ena_com_dev *ena_dev);
 796
 797 /* ena_com_set_host_attributes - Update the device with the host
 798  * attributes (debug area and host info) base address.
 799  * @ena_dev: ENA communication layer struct
 800  *
 801  * @return: 0 on Success and negative value otherwise.
 802  */
 803 int ena_com_set_host_attributes(struct ena_com_dev *ena_dev);
 804
 805 /* ena_com_create_io_cq - Create io completion queue.
 806  * @ena_dev: ENA communication layer struct
 807  * @io_cq - io completion queue handler
 808
 809  * Create IO completion queue.
 810  *
 811  * @return - 0 on success, negative value on failure.
 812  */
 813 int ena_com_create_io_cq(struct ena_com_dev *ena_dev,
 814                          struct ena_com_io_cq *io_cq);
 815
 816 /* ena_com_destroy_io_cq - Destroy io completion queue.
 817  * @ena_dev: ENA communication layer struct
 818  * @io_cq - io completion queue handler
 819
 820  * Destroy IO completion queue.
 821  *
 822  * @return - 0 on success, negative value on failure.
 823  */
 824 int ena_com_destroy_io_cq(struct ena_com_dev *ena_dev,
 825                           struct ena_com_io_cq *io_cq);
 826
 827 /* ena_com_execute_admin_command - Execute admin command
 828  * @admin_queue: admin queue.
 829  * @cmd: the admin command to execute.
 830  * @cmd_size: the command size.
 831  * @cmd_completion: command completion return value.
 832  * @cmd_comp_size: command completion size.
 833
 834  * Submit an admin command and then wait until the device will return a
 835  * completion.
 836  * The completion will be copyed into cmd_comp.
 837  *
 838  * @return - 0 on success, negative value on failure.
 839  */
 840 int ena_com_execute_admin_command(struct ena_com_admin_queue *admin_queue,
 841                                   struct ena_admin_aq_entry *cmd,
 842                                   size_t cmd_size,
 843                                   struct ena_admin_acq_entry *cmd_comp,
 844                                   size_t cmd_comp_size);
 845
 846 /* ena_com_init_interrupt_moderation - Init interrupt moderation
 847  * @ena_dev: ENA communication layer struct
 848  *
 849  * @return - 0 on success, negative value on failure.
 850  */
 851 int ena_com_init_interrupt_moderation(struct ena_com_dev *ena_dev);
 852
 853 /* ena_com_destroy_interrupt_moderation - Destroy interrupt moderation resources
 854  * @ena_dev: ENA communication layer struct
 855  */
 856 void ena_com_destroy_interrupt_moderation(struct ena_com_dev *ena_dev);
 857
 858 /* ena_com_interrupt_moderation_supported - Return if interrupt moderation
 859  * capability is supported by the device.
 860  *
 861  * @return - supported or not.
 862  */
 863 bool ena_com_interrupt_moderation_supported(struct ena_com_dev *ena_dev);
 864
 865 /* ena_com_config_default_interrupt_moderation_table - Restore the interrupt
 866  * moderation table back to the default parameters.
 867  * @ena_dev: ENA communication layer struct
 868  */
 869 void ena_com_config_default_interrupt_moderation_table(struct ena_com_dev *ena_dev);
 870
 871 /* ena_com_update_nonadaptive_moderation_interval_tx - Update the
 872  * non-adaptive interval in Tx direction.
 873  * @ena_dev: ENA communication layer struct
 874  * @tx_coalesce_usecs: Interval in usec.
 875  *
 876  * @return - 0 on success, negative value on failure.
 877  */
 878 int ena_com_update_nonadaptive_moderation_interval_tx(struct ena_com_dev *ena_dev,
 879                                                       u32 tx_coalesce_usecs);
 880
 881 /* ena_com_update_nonadaptive_moderation_interval_rx - Update the
 882  * non-adaptive interval in Rx direction.
 883  * @ena_dev: ENA communication layer struct
 884  * @rx_coalesce_usecs: Interval in usec.
 885  *
 886  * @return - 0 on success, negative value on failure.
 887  */
 888 int ena_com_update_nonadaptive_moderation_interval_rx(struct ena_com_dev *ena_dev,
 889                                                       u32 rx_coalesce_usecs);
 890
 891 /* ena_com_get_nonadaptive_moderation_interval_tx - Retrieve the
 892  * non-adaptive interval in Tx direction.
 893  * @ena_dev: ENA communication layer struct
 894  *
 895  * @return - interval in usec
 896  */
 897 unsigned int ena_com_get_nonadaptive_moderation_interval_tx(struct ena_com_dev *ena_dev);
 898
 899 /* ena_com_get_nonadaptive_moderation_interval_rx - Retrieve the
 900  * non-adaptive interval in Rx direction.
 901  * @ena_dev: ENA communication layer struct
 902  *
 903  * @return - interval in usec
 904  */
 905 unsigned int ena_com_get_nonadaptive_moderation_interval_rx(struct ena_com_dev *ena_dev);
 906
 907 /* ena_com_init_intr_moderation_entry - Update a single entry in the interrupt
 908  * moderation table.
 909  * @ena_dev: ENA communication layer struct
 910  * @level: Interrupt moderation table level
 911  * @entry: Entry value
 912  *
 913  * Update a single entry in the interrupt moderation table.
 914  */
 915 void ena_com_init_intr_moderation_entry(struct ena_com_dev *ena_dev,
 916                                         enum ena_intr_moder_level level,
 917                                         struct ena_intr_moder_entry *entry);
 918
 919 /* ena_com_get_intr_moderation_entry - Init ena_intr_moder_entry.
 920  * @ena_dev: ENA communication layer struct
 921  * @level: Interrupt moderation table level
 922  * @entry: Entry to fill.
 923  *
 924  * Initialize the entry according to the adaptive interrupt moderation table.
 925  */
 926 void ena_com_get_intr_moderation_entry(struct ena_com_dev *ena_dev,
 927                                        enum ena_intr_moder_level level,
 928                                        struct ena_intr_moder_entry *entry);
 929
 930 static inline bool ena_com_get_adaptive_moderation_enabled(struct ena_com_dev *ena_dev)
 931 {
 932         return ena_dev->adaptive_coalescing;
 933 }
 934
 935 static inline void ena_com_enable_adaptive_moderation(struct ena_com_dev *ena_dev)
 936 {
 937         ena_dev->adaptive_coalescing = true;
 938 }
 939
 940 static inline void ena_com_disable_adaptive_moderation(struct ena_com_dev *ena_dev)
 941 {
 942         ena_dev->adaptive_coalescing = false;
 943 }
 944
 945 /* ena_com_calculate_interrupt_delay - Calculate new interrupt delay
 946  * @ena_dev: ENA communication layer struct
 947  * @pkts: Number of packets since the last update
 948  * @bytes: Number of bytes received since the last update.
 949  * @smoothed_interval: Returned interval
 950  * @moder_tbl_idx: Current table level as input update new level as return
 951  * value.
 952  */
 953 static inline void ena_com_calculate_interrupt_delay(struct ena_com_dev *ena_dev,
 954                                                      unsigned int pkts,
 955                                                      unsigned int bytes,
 956                                                      unsigned int *smoothed_interval,
 957                                                      unsigned int *moder_tbl_idx)
 958 {
 959         enum ena_intr_moder_level curr_moder_idx, new_moder_idx;
 960         struct ena_intr_moder_entry *curr_moder_entry;
 961         struct ena_intr_moder_entry *pred_moder_entry;
 962         struct ena_intr_moder_entry *new_moder_entry;
 963         struct ena_intr_moder_entry *intr_moder_tbl = ena_dev->intr_moder_tbl;
 964         unsigned int interval;
 965
 966         /* We apply adaptive moderation on Rx path only.
 967          * Tx uses static interrupt moderation.
 968          */
 969         if (!pkts || !bytes)
 970                 /* Tx interrupt, or spurious interrupt,
 971                  * in both cases we just use same delay values
 972                  */
 973                 return;
 974
 975         curr_moder_idx = (enum ena_intr_moder_level)(*moder_tbl_idx);
 976         if (unlikely(curr_moder_idx >= ENA_INTR_MAX_NUM_OF_LEVELS)) {
 977                 pr_err("Wrong moderation index %u\n", curr_moder_idx);
 978                 return;
 979         }
 980
 981         curr_moder_entry = &intr_moder_tbl[curr_moder_idx];
 982         new_moder_idx = curr_moder_idx;
 983
 984         if (curr_moder_idx == ENA_INTR_MODER_LOWEST) {
 985                 if ((pkts > curr_moder_entry->pkts_per_interval) ||
 986                     (bytes > curr_moder_entry->bytes_per_interval))
 987                         new_moder_idx =
 988                                 (enum ena_intr_moder_level)(curr_moder_idx + ENA_INTR_MODER_LEVEL_STRIDE);
 989         } else {
 990                 pred_moder_entry = &intr_moder_tbl[curr_moder_idx - ENA_INTR_MODER_LEVEL_STRIDE];
 991
 992                 if ((pkts <= pred_moder_entry->pkts_per_interval) ||
 993                     (bytes <= pred_moder_entry->bytes_per_interval))
 994                         new_moder_idx =
 995                                 (enum ena_intr_moder_level)(curr_moder_idx - ENA_INTR_MODER_LEVEL_STRIDE);
 996                 else if ((pkts > curr_moder_entry->pkts_per_interval) ||
 997                          (bytes > curr_moder_entry->bytes_per_interval)) {
 998                         if (curr_moder_idx != ENA_INTR_MODER_HIGHEST)
 999                                 new_moder_idx =
1000                                         (enum ena_intr_moder_level)(curr_moder_idx + ENA_INTR_MODER_LEVEL_STRIDE);
1001                 }
1002         }
1003         new_moder_entry = &intr_moder_tbl[new_moder_idx];
1004
1005         interval = new_moder_entry->intr_moder_interval;
1006         *smoothed_interval = (
1007                 (interval * ENA_INTR_DELAY_NEW_VALUE_WEIGHT +
1008                 ENA_INTR_DELAY_OLD_VALUE_WEIGHT * (*smoothed_interval)) + 5) /
1009                 10;
1010
1011         *moder_tbl_idx = new_moder_idx;
1012 }
1013
1014 /* ena_com_update_intr_reg - Prepare interrupt register
1015  * @intr_reg: interrupt register to update.
1016  * @rx_delay_interval: Rx interval in usecs
1017  * @tx_delay_interval: Tx interval in usecs
1018  * @unmask: unask enable/disable
1019  *
1020  * Prepare interrupt update register with the supplied parameters.
1021  */
1022 static inline void ena_com_update_intr_reg(struct ena_eth_io_intr_reg *intr_reg,
1023                                            u32 rx_delay_interval,
1024                                            u32 tx_delay_interval,
1025                                            bool unmask)
1026 {
1027         intr_reg->intr_control = 0;
1028         intr_reg->intr_control |= rx_delay_interval &
1029                 ENA_ETH_IO_INTR_REG_RX_INTR_DELAY_MASK;
1030
1031         intr_reg->intr_control |=
1032                 (tx_delay_interval << ENA_ETH_IO_INTR_REG_TX_INTR_DELAY_SHIFT)
1033                 & ENA_ETH_IO_INTR_REG_TX_INTR_DELAY_MASK;
1034
1035         if (unmask)
1036                 intr_reg->intr_control |= ENA_ETH_IO_INTR_REG_INTR_UNMASK_MASK;
1037 }
1038
1039 #endif /* !(ENA_COM) */