packages/hal/arm/xscale/grg/v2_0/src/grg_pci.c

   1 //==========================================================================
   2 //
   3 //      grg_pci.c
   4 //
   5 //      HAL PCI board support code for Intel XScale GRG
   6 //
   7 //==========================================================================
   8 //####ECOSGPLCOPYRIGHTBEGIN####
   9 // -------------------------------------------
  10 // This file is part of eCos, the Embedded Configurable Operating System.
  11 // Copyright (C) 1998, 1999, 2000, 2001, 2002, 2003 Red Hat, Inc.
  12 //
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  14 // the terms of the GNU General Public License as published by the Free
  15 // Software Foundation; either version 2 or (at your option) any later version.
  16 //
  17 // eCos is distributed in the hope that it will be useful, but WITHOUT ANY
  18 // WARRANTY; without even the implied warranty of MERCHANTABILITY or
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  20 // for more details.
  21 //
  22 // You should have received a copy of the GNU General Public License along
  23 // with eCos; if not, write to the Free Software Foundation, Inc.,
  24 // 59 Temple Place, Suite 330, Boston, MA 02111-1307 USA.
  25 //
  26 // As a special exception, if other files instantiate templates or use macros
  27 // or inline functions from this file, or you compile this file and link it
  28 // with other works to produce a work based on this file, this file does not
  29 // by itself cause the resulting work to be covered by the GNU General Public
  30 // License. However the source code for this file must still be made available
  31 // in accordance with section (3) of the GNU General Public License.
  32 //
  33 // This exception does not invalidate any other reasons why a work based on
  34 // this file might be covered by the GNU General Public License.
  35 //
  36 // Alternative licenses for eCos may be arranged by contacting Red Hat, Inc.
  37 // at http://sources.redhat.com/ecos/ecos-license/
  38 // -------------------------------------------
  39 //####ECOSGPLCOPYRIGHTEND####
  40 //==========================================================================
  41 //#####DESCRIPTIONBEGIN####
  42 //
  43 // Author(s):    msalter
  44 // Contributors: msalter
  45 // Date:         2003-02-05
  46 // Purpose:      HAL PCI board support
  47 // Description:  Implementations of HAL board interfaces
  48 //
  49 //####DESCRIPTIONEND####
  50 //
  51 //========================================================================*/
  52 #include <pkgconf/hal.h>
  53 #include <pkgconf/system.h>
  54 #include CYGBLD_HAL_PLATFORM_H
  55
  56 #ifdef CYGPKG_IO_PCI
  57
  58 #include <cyg/infra/cyg_type.h>         // base types
  59 #include <cyg/infra/cyg_trac.h>         // tracing macros
  60 #include <cyg/infra/cyg_ass.h>          // assertion macros
  61
  62 #include <cyg/hal/hal_io.h>             // IO macros
  63 #include <cyg/hal/hal_if.h>             // calling interface API
  64 #include <cyg/hal/hal_arch.h>           // Register state info
  65 #include <cyg/hal/hal_diag.h>
  66 #include <cyg/hal/hal_intr.h>           // Interrupt names
  67 #include <cyg/hal/hal_cache.h>
  68 #include <cyg/io/pci_hw.h>
  69 #include <cyg/io/pci.h>
  70
  71
  72 #define IXP425_PCI_MAX_DEV      4
  73 #define IXP425_PCI_IRQ_LINES    4
  74
  75 // PCI pin mappings
  76 #define PCI_CLK_GPIO     14  // CLK0
  77 #define PCI_RESET_GPIO   12
  78 #define PCI_INTA_GPIO    11
  79
  80 #define INTA    CYGNUM_HAL_INTERRUPT_GPIO11
  81
  82 void
  83 cyg_hal_plf_pci_translate_interrupt(cyg_uint32 bus, cyg_uint32 devfn,
  84                                     CYG_ADDRWORD *vec, cyg_bool *valid)
  85 {
  86     *vec = INTA;
  87     *valid = true;
  88 }
  89
  90
  91 #define HAL_PCI_CLOCK_ENABLE() \
  92     *IXP425_GPCLKR |= GPCLKR_CLK0_ENABLE;  // GPIO(0) used for PCI clock
  93
  94 #define HAL_PCI_CLOCK_DISABLE() \
  95     *IXP425_GPCLKR &= ~GPCLKR_CLK0_ENABLE;  // GPIO(0) used for PCI clock
  96
  97 #define HAL_PCI_CLOCK_CONFIG() \
  98     *IXP425_GPCLKR |= GPCLKR_CLK0_PCLK2;
  99
 100 #define HAL_PCI_RESET_ASSERT() \
 101     HAL_GPIO_OUTPUT_CLEAR(PCI_RESET_GPIO);
 102
 103 #define HAL_PCI_RESET_DEASSERT() \
 104     HAL_GPIO_OUTPUT_SET(PCI_RESET_GPIO);
 105
 106 void
 107 hal_plf_pci_init(void)
 108 {
 109 #if defined(CYG_HAL_STARTUP_ROM) || defined(CYG_HAL_STARTUP_ROMRAM)
 110     HAL_PCI_RESET_ASSERT();
 111     HAL_PCI_CLOCK_DISABLE();
 112
 113     // Set GPIO line direction
 114     HAL_GPIO_OUTPUT_ENABLE(PCI_CLK_GPIO);
 115     HAL_GPIO_OUTPUT_ENABLE(PCI_RESET_GPIO);
 116     HAL_GPIO_OUTPUT_DISABLE(PCI_INTA_GPIO);
 117
 118     // configure PCI interrupt lines for active low irq
 119     HAL_INTERRUPT_CONFIGURE(INTA, 1, 0);
 120
 121     // wait 1ms to satisfy "minimum reset assertion time" of the PCI spec.
 122     HAL_DELAY_US(1000);
 123     HAL_PCI_CLOCK_CONFIG();
 124     HAL_PCI_CLOCK_ENABLE();
 125
 126     // wait 100us to satisfy "minimum reset assertion time from clock stable"
 127     // requirement of the PCI spec.
 128     HAL_DELAY_US(100);
 129     HAL_PCI_RESET_DEASSERT();
 130 #endif
 131 }
 132
 133 #endif // CYGPKG_IO_PCI